參數(shù)資料
型號： XRT74L73IB
廠商： EXAR CORP
元件分類： 數(shù)字傳輸電路
英文描述： 3 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
中文描述： DATACOM, FRAMER, PBGA388
封裝： 35 X 35 MM, PLASTIC, BGA-388
文件頁數(shù)： 212/488頁
文件大?。?/td> 2829K
代理商： XRT74L73IB
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XRT74L73
3 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
REV. P1.0.1
PRELIMINARY
213
register, in order to keep the Transmit FEAC Processor
enabled.
Once this step has been completed, the Transmit
FEAC Processor will proceed to transmit the 16 bit
FEAC code via the outbound DS3 frames. This 16 bit
FEAC message will be transmitted repeatedly 10
consecutive times. Hence, this process will require a
total of 160 DS3 Frames. During this process the Tx
FEAC Busy bit (Bit 0, within the Transmit DS3 FEAC
Configuration and Status register) will be asserted, in-
dicating that the Tx FEAC Processor is currently
transmitting the FEAC Message to the remote Termi-
nal. This bit-field will toggle to "0" upon completion of
the 10th transmission of the FEAC Code Message.
The Transmit FEAC Processor will generate an inter-
rupt (if enabled) to the local μP/μC, upon completion
of the 10th transmission of the FEAC Message. The
purpose of having the Framer IC generating this inter-
rupt is to let the local μP/μC know that the Transmit
FEAC Processor is now available and ready to trans-
mit a new FEAC message. Finally, once the Transmit
FEAC Processor has completed its 10th transmission
of a FEAC Code Message it will then begin sending
all 1s in the FEAC bit-field of each DS3 Frame. The
Receive FEAC Processor (at the remote terminal
equipment) will interpret this all 1s message as an
Idle FEAC Message. The Transmit FEAC Processor
will continue sending all 1s in the FEAC bit field, for
an indefinite period of time, until the local μP/μC com-
mands it to transmit a new FEAC message.
Figure 68 presents a flow chart depicting how to use
the Transmit FEAC Processor.
N
OTE
:
For a detailed description of the Receive FEAC Pro-
cessor (within the Receive DS3 HDLC Controller block),
please see Section
4.3.3.1
.
4.2.3.2
LAP-D) processing via the Transmit DS3 HDLC
Controller
Message-Oriented Signaling (e.g.,
F
IGURE
68. A F
LOW
C
HART
DEPICTING
HOW
TO
TRANSMIT
A
FEAC M
ESSAGE
VIA
THE
FEAC T
RANSMITTER
START
WRITE SIX-BIT “OUTBOUND” FEAC VALUE
INTO THE TxDS3 FEAC Register
This register is located at Address 0x32.
ENABLE THE TRANSMIT FEAC PROCESSOR.
This is accomplished by writing “xxxx x1xx”
into the TxDS3 FEAC Configuration & Status Register
INITIATE TRANSMISSION OF THE “OUTBOUND”
FEAC MESSAGE.
This is accomplished by writing “xxxx xx1x” into the
TxDS3 FEAC Configuration & Status Register.
.
TRANSMIT FEAC PROCESSOR ENCAPSULATES
THE “OUTBOUND” FEAC VALUE INTO A 16 BIT
FRAMING STRUCTURE
.
TRANSMIT FEAC PROCESSOR PROCEEDS TO
INSERT THE 16-BIT MESSAGE (IN A BIT-BY-BIT
MANNER) INTO THE “FEAC” BIT-FIELDS OF
EACH OUTBOUND DS3 FRAME.
Is
Transmission
of the 16 Bit FEAC
Message
Complete
Has
the 16-bit
FEAC Message been
transmitted to the
Remote Terminal
10 times
GENERATE THE TRANSMIT FEAC
INTERRUPT
INVOKE THE “TRANSMIT FEAC INTERRUPT
SERVICE ROUTINE.
1
1
1
1
NO
YES
NO
YES
相關(guān)PDF資料
PDF描述
XRT74L74 4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
XRT74L74IB 4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
XRT75L00D E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER
XRT75L00DIV E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER
XRT75L02 TWO CHANNEL E3/DS3/STS-1 LINE INTERFACE UNIT WITH JITTER
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
XRT74L74 制造商:EXAR 制造商全稱:EXAR 功能描述:4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
XRT74L74IB 制造商:EXAR 制造商全稱:EXAR 功能描述:4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
XRT75L00 制造商:EXAR 制造商全稱:EXAR 功能描述:E3/DS3/STS-1 LINE INTERFACE UNIT WITH JITTER ATTENUATOR
XRT75L00D 制造商:EXAR 制造商全稱:EXAR 功能描述:E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER
XRT75L00DES 功能描述:時鐘合成器/抖動清除器 LIU+DESYNCH 3.3V LIU+DESYNCH 3.3V RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
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