參數(shù)資料
型號: XRT94L31_07
廠商: Exar Corporation
英文描述: 3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER IC
中文描述: 3通道DS3/E3/STS-1給STS-3/STM-1映射器集成電路
文件頁數(shù): 109/133頁
文件大?。?/td> 1014K
代理商: XRT94L31_07
XRT94L31
109
REV. 1.0.1
3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER IC
N
OTE
:
The value for t2 and t3 can be found in
Table 9
.
1.3.2
STS-3/STM-1 PECL INTERFACE TIMING INFORMATION
1.3.2.1
The Receive STS-3/STM-1 PECL Interface Timing
The Receive STS-3/STM-1 PECL Interface block samples the incoming STS-3/STM-1 signal (which is present
on the RxL_Data_p/RxL_Data_n input pins) upon the rising edge of the RxL_CLKL_p/RxL_CLKL_n input clock
signal.
F
IGURE
14. A
N
I
LLUSTRATION
OF
THE
W
AVEFORMS
OF
THE
S
IGNALS
THAT
ARE
I
NPUT
VIA
THE
R
ECEIVE
STS-3/
STM-1 T
ELECOM
B
US
I
NTERFACE
T
ABLE
9: T
IMING
I
NFORMATION
FOR
THE
R
ECEIVE
STS-3/STM-1 T
ELECOM
B
US
I
NTERFACE
S
YMBOL
D
ESCRIPTION
M
IN
.
T
YP
.
M
AX
.
t2
RxD_D[7:0], RxD_PL, RxD_C1J1, RxD_ALARM and RxD_DP
to falling edge of RxD_CLK set-up time requirements
4 ns
t3
Falling edge of RxD_CLK to RxD_D[7:0], RxD_PL, RxD_C1J1,
RxD_ALARM and RxD_DP hold time requirements
0 ns
RxD_CLK
RxD_D[7:0]
RxD_PL
RxD_C1J1
A2 C1 C1
J1 Data Data
t2
t3
相關(guān)PDF資料
PDF描述
XRT94L31 3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER
XRT94L31IB 3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER
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XRT94L43IB SONET/SDH STS-12/STM-4 TO E3/DS3/STS-1 MAPPER/DEMAPPER
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參數(shù)描述
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