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參數(shù)資料
| 型號： | ZL50418GKC |
| 廠商： | Zarlink Semiconductor Inc. |
| 英文描述： | Managed 16-Port 10/100 M + 2-Port 1 G Ethernet Switch |
| 中文描述： | 管理16端口10/100平方米端口1個G以太網(wǎng)交換機(jī) |
| 文件頁數(shù)： | 126/163頁 |
| 文件大小： | 2122K |
| 代理商： | ZL50418GKC |
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ZL50418
Data Sheet
126
Zarlink Semiconductor Inc.
15.2.2 Ball – Signal Descriptions in Unmanaged Mode
Ball No(s)
Symbol
I/O
Description
I
2
C Interface Note: In unmanaged mode, Use I
2
C and Serial control interface to configure the system
A24
SCL
Output
I
2
C Data Clock
I
2
C Data I/O
A25
SDA
I/O-TS with internal
pull up
Serial Control Interface
A26
STROBE
Input with weak
internal pull up
Serial Strobe Pin
B26
D0
Input with weak
internal pull up
Serial Data Input
C25
AUTOFD
Output with pull up
Serial Data Output (AutoFD)
Frame Buffer Interface
D20, B21, D19,
E19,D18, E18, D17,
E17, D16, E16, D15,
E15, D14, E14, D13,
E13, D21, E21, A18,
B18, C18, A17, B17,
C17, A16, B16, C16,
A15, B15, C15, A14,
B14, D9, E9, D8, E8,
D7, E7, D6, E6, D5,
E5, D4, E4, D3, E3,
D2, E2, A7, B7, A6, B6,
C6, A5, B5, C5, A4, B4,
C4, A3, B3, C3, B2, C2
LA_D[63:0]
I/O-TS with pull up
Frame Bank A– Data Bit [63:0]
C14, A13, B13, C13,
A12, B12, C12, A11,
B11, C11, D11, E11,
A10, B10, D10, E10,
A8, C7
LA_A[20:3]
Output
Frame Bank A – Address Bit [20:3]
B8
LA_ADSC#
Output with pull up
Frame Bank A Address Status
Control
C1
LA_CLK
Output with pull up
Frame Bank A Clock Input
C9
LA_WE#
Output with pull up
Frame Bank A Write Chip Select for
one layer SRAM application
D12
LA_WE0#
Output with pull up
Frame Bank A Write Chip Select for
lower layer of two bank SRAM
application
E12
LA_WE1#
Output with pull up
Frame Bank A Write Chip Select for
upper bank of two layer SRAM
application
C8
LA_OE#
Output with pull up
Frame Bank A Read Chip Select for
one layer SRAM application
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