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參數(shù)資料
| 型號： | ZL50418GKC |
| 廠商： | Zarlink Semiconductor Inc. |
| 英文描述： | Managed 16-Port 10/100 M + 2-Port 1 G Ethernet Switch |
| 中文描述： | 管理16端口10/100平方米端口1個G以太網(wǎng)交換機 |
| 文件頁數(shù)： | 62/163頁 |
| 文件大?。?/td> | 2122K |
| 代理商： | ZL50418GKC |
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ZL50418
Data Sheet
62
Zarlink Semiconductor Inc.
14.2.7 Control Command Frame Buffer1 Access Register
Address = 6 (read/write)
When CPU writes to this register, data is written to the Control Command Frame Receive Buffer
When CPU reads this register, data is read from the Control Command Frame Transmit Buffer1
14.2.8 Control Command Frame Buffer2 Access Register
Address = 7 (read only)
When CPU reads this register, data is read from the Control Command Frame Transmit Buffer1
Indirectly Accessed Registers
14.3 (Group 0 Address) MAC Ports Group
14.3.1 ECR1Pn: Port N Control Register
I
2
C Address 000 - 01A; CPU Address:0000+2xN (N = port number)
Accessed by CPU, serial interface and I
2
C (R/W)
7
6
5
4
3
2
1
0
Sp State
A-FC
Port Mode
Bit [0]
1 - Flow Control Off
0 - Flow Control On
When Flow Control On:
In half duplex mode the MAC transmitter applies back pressure for flow control.
In full duplex mode the MAC transmitter sends Flow Control frames when
necessary. The MAC receiver interprets and processes incoming flow control
frames. The Flow Control Frame Received counter is incremented whenever a flow
control is received.
When Flow Control off:
In half duplex mode the MAC Transmitter does not assert flow control by sending
flow control frames or jamming collision.
In full duplex mode the Mac transmitter does not send flow control frames. The
MAC receiver does not interpret or process the flow control frames. The Flow
Control Frame Received counter is not incremented.
Bit [1]
- 1 - Half Duplex - Only in 10/100 mode
- 0 - Full Duplex
Bit [2]
- 1 - 10Mbps
- 0 - 100Mbps
相關PDF資料 |
PDF描述 |
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