參數(shù)資料
型號： A42MX36-CQ256A
元件分類： FPGA
英文描述： FPGA, 54000 GATES, CQFP256
封裝： CERAMIC, QFP-256
文件頁數(shù)： 11/76頁
文件大?。?/td> 429K
代理商： A42MX36-CQ256A
MX Automotive Family FPGAs
v2.0
1-13
Timing Information
* Values are shown for 40MX at worst-case 5.0V automotive conditions.
Figure 1-12 40MX Timing Model*
*Values are shown for A42MX09 at worst-case 5.0V automotive conditions
Input module predicted routing delay
Figure 1-13 42MX Timing Model*
Output Delay
Input Delay
I/O Module
INYL = 1.22 ns
IRD2 = 4.89 ns
Logic Module
PD = 2.32 ns
I/O Module
tRD1 = 2.45 ns
DLH = 6.24 ns
Array
Clock
MAX = 164 MHz
t RD4 = 5.38 ns
t RD8 = 9.29 ns
Predicted
Routing
Delays
CKH = 8.57 ns
FO = 128
= 3.92 ns
= 6.85 ns
= 10.77 ns
CO = 2.32 ns
ENHZ = 14.93 ns
tRD2 = 3.43 ns
Internal Delays
t
F
t
IRD1
IRD4
IRD8
t
Output Delays
I/O Module
t
DLH = 4.23 ns
I/O Module
tOUTH= 0.00 ns
tOUTSU= 0.47 ns
tGLH= 4.47 ns
t DLH= 4.23 ns
tENHZ = 8.58 ns
tRD1 = 0.80 ns
t
INH= 0.00 ns
tINSU= 0.47 ns
tINGL= 2.23 ns
Array
Clocks
tCKH = 4.23 ns
DQ
tCO= 2.23 ns
G
Internal Delays
Input Delays
I/O Module
DQ
tINYL= 1.41 ns
tIRD1 =
Combinatorial
Logic Module
t
PD = 2.12 ns
Sequential
Logic Module
t RD1= 1.18 ns
FMAX = 229 MHz
DQ
tSUD = 0.59 ns
tHD= 0.00 ns
tRD4 = 2.35 ns
tRD8 = 3.99 ns
Predicted
Routing
Delays
G
FO = 32
tRD2 = 1.65 ns
tLCO = 9.05 ns (light loads, pad-to-pad)
3.53 ns
Combin-
atorial
Logic
included
in tSUD
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PDF描述
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