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參數(shù)資料
| 型號： | AD9511BCPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 44/60頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK DIST 5OUT PLL 48LFCSP |
| 標準包裝： | 1 |
| 類型： | 扇出緩沖器（分配），除法器 |
| PLL： | 是 |
| 輸入： | 時鐘 |
| 輸出： | CMOS，LVDS，LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:5 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 1.2GHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-VFQFN 裸露焊盤，CSP |
| 供應商設(shè)備封裝： | 48-LFCSP-VQ（7x7） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 776 (CN2011-ZH PDF) |
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AD9511
Rev. A | Page 49 of 60
Reg.
Addr.
(Hex)
Bit(s) Name
Description
0A
<1:0> PLL Power-Down
01 = Asynchronous Power-Down (Default).
<1>
<0>
Mode
0
Normal Operation
0
1
Asynchronous Power-Down
1
0
Normal Operation
1
Synchronous Power-Down
0A
<4:2> Prescaler Value
(P/P+1)
<4>
<3>
<2> Mode
Prescaler Mode
0
FD
Divide by 1
0
1
FD
Divide by 2
0
1
0
DM
2/3
0
1
DM
4/5
1
0
DM
8/9
1
0
1
DM
16/17
1
0
DM
32/33
1
FD
Divide by 3
DM = Dual Modulus, FD = Fixed Divide.
0A
<5>
Not Used.
0A
<6>
B Counter Bypass
Only valid when operating the prescaler in fixed divide (FD) mode. When this bit is set, the
B counter is divided by 1. This allows the prescaler setting to determine the divide for the
N divider.
0A
<7>
Not Used.
0B
<5:0> 14-Bit Reference
Counter, MSBs
R Divider (MSB) <13:8>.
0C
<7:0> 14-Bit Reference
Counter, R LSBs
R Divider (MSB) <7:0>.
0D
<1:0> Antibacklash
Pulse-Width
<1>
<0>
Antibacklash Pulse Width (ns)
0
1.3 (Default)
0
1
2.9
1
0
6.0
1
1.3
0D
<4:2>
Not Used.
0D
<5>
Digital Lock
Detect Window
<5>
Digital Lock Detect Window (ns)
Digital Lock Detect Loss-of-Lock Threshold (ns)
0 (Default)
9.5
15
1
3.5
7
Digital Lock
Detect Window
If the time difference of the rising edges at the inputs to the PFD are less than the lock detect
window time, the digital lock detect flag is set. The flag remains set until the time difference is
greater than the loss-of-lock threshold.
0D
<6>
Lock Detect
Disable
0 = Normal Lock Detect Operation (Default).
1 = Disable Lock Detect.
0D
<7>
Not Used.
Unused
0E-33
Not Used.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| V110A48H300BL | CONVERTER MOD DC/DC 48V 300W |
| VI-B60-MV | CONVERTER MOD DC/DC 5V 150W |
| AD9518-2ABCPZ | IC CLOCK GEN 6CH 2.2GHZ 48LFCSP |
| VI-B4Z-MV-B1 | CONVERTER MOD DC/DC 2V 60W |
| VI-B3D-MW-B1 | CONVERTER MOD DC/DC 85V 100W |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AD9511BCPZ-REEL | 制造商:AD 制造商全稱:Analog Devices 功能描述:1.2 GHz Clock Distribution IC, PLL Core, Dividers, Delay Adjust, Five Outputs |
| AD9511BCPZ-REEL7 | 功能描述:IC CLOCK DIST 5OUT PLL 48LFCSP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:- 標準包裝:2,000 系列:- 類型:PLL 時鐘發(fā)生器 PLL:帶旁路 輸入:LVCMOS，LVPECL 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:2:11 差分 - 輸入:輸出:是/無 頻率 - 最大:240MHz 除法器/乘法器:是/無 電源電壓:3.135 V ~ 3.465 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:32-LQFP 供應商設(shè)備封裝:32-TQFP（7x7） 包裝:帶卷 (TR) |
| AD9511-VCO/PCB | 制造商:Analog Devices 功能描述:EVAL BD FOR AD9511 1.2 GHZ CLOCK DISTRIBUTION IC, PLL CORE,D - Bulk |
| AD9512 | 制造商:AD 制造商全稱:Analog Devices 功能描述:800 MHz Clock Distribution IC,1.5 GHz Inputs, Dividers, Delay Adjust, Five Outputs |
| AD9512/PCB | 制造商:Analog Devices 功能描述:Evaluation Kit For 1.2 GHZ Clock Distribution IC, 1.6 GHZ Inputs, Dividers, Delay Adjust, Five Outputs 制造商:Analog Devices 功能描述:EVAL KIT FOR 1.2 GHZ CLOCK DISTRIBUTION IC, 1.6 GHZ INPUTS, - Bulk |
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