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參數(shù)資料
| 型號(hào)： | AD9548/PCBZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 10/112頁 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR AD9548 |
| 產(chǎn)品變化通告： | AD9548 Mask Change 20/Oct/2010 |
| 設(shè)計(jì)資源： | AD9548 Schematic AD9548 BOM AD9548 Eval Brd Layers |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 主要目的： | 計(jì)時(shí)，時(shí)鐘發(fā)生器 |
| 嵌入式： | 否 |
| 已用 IC / 零件： | AD9548 |
| 主要屬性： | 62.5 ~ 450 MHz 輸出頻率 |
| 次要屬性： | SPI 和 I2C 兼容控制端口 |
| 已供物品： | 板 |
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Data Sheet
AD9548
Rev. E | Page 107 of 112
POWER SUPPLY PARTITIONS
The AD9548 features multiple power supplies, and their power
consumption varies with the AD9548 configuration. This
section provides information about which power supplies can
be grouped together and how the power consumption of each
block varies with frequency.
The numbers quoted here are for comparison only. Please refer
to the Specifications section for exact numbers. With each group,
bypass capacitors of 1 μF in parallel with 10 μF should be used.
Upon applying power to the device, internal circuitry monitors
the 1.8 V digital core supply and the 3.3 V digital I/O supply.
When these supplies cross the desired threshold level, the device
generates an internal 10 μs reset pulse. This pulse does not
appear on the RESET pin.
3.3 V SUPPLIES
The 3.3 V supply domain consists of two main partitions, digital
(DVDD3) and analog (AVDD3). Take care to keep these two
supply domains separate.
Furthermore, the AVDD3 consists of two subdomains: the clock
distribution output domain (Pin 31, Pin 37, Pin 38, and Pin 44)
and the rest of the AVDD3 supply connections. Generally, these
supply domains can be joined together. However, if an application
requires 1.8 V CMOS driver operation in the clock distribution
output block, then provide one 1.8 V supply domain to power
the clock distribution output block. Each output driver has a
dedicated supply pin, as shown in Table 155.
Table 155. Output Driver Supply Pins
Output Driver
Supply Pin
OUT0
31
OUT1
37
OUT2
38
OUT3
44
1.8 V SUPPLIES
The 1.8 V supply domain consists of two main partitions, digital
(DVDD) and analog (AVDD). These two supply domains must
be kept separate.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SFSD-15-28-H-10.00-DR-NUX | CABLE ASSY SOCKET 30POS 28AWG |
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| GBC13DRXS-S734 | CONN EDGECARD 26POS DIP .100 SLD |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AD9548XCPZ | 制造商:Analog Devices 功能描述: |
| AD9549 | 制造商:AD 制造商全稱:Analog Devices 功能描述:Dual Input Network Clock Generator/Synchronizer |
| AD9549/PCBZ | 制造商:Analog Devices 功能描述:DUAL INPUT NETWORK CLOCK GEN/SYNCHRONIZER - Bulk |
| AD9549A/PCBZ | 功能描述:BOARD EVALUATION FOR AD9549A RoHS:是 類別:編程器，開發(fā)系統(tǒng) >> 評(píng)估演示板和套件 系列:- 標(biāo)準(zhǔn)包裝:1 系列:PSoC® 主要目的:電源管理，熱管理 嵌入式:- 已用 IC / 零件:- 主要屬性:- 次要屬性:- 已供物品:板，CD，電源 |
| AD9549ABCPZ | 功能描述:IC CLOCK GEN/SYNCHRONIZR 64LFCSP RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 專用 系列:- 標(biāo)準(zhǔn)包裝:1 系列:- 類型:時(shí)鐘/頻率發(fā)生器，多路復(fù)用器 PLL:是 主要目的:存儲(chǔ)器，RDRAM 輸入:晶體 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:1:2 差分 - 輸入:輸出:無/是 頻率 - 最大:400MHz 電源電壓:3 V ~ 3.6 V 工作溫度:0°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應(yīng)商設(shè)備封裝:16-TSSOP 包裝:Digi-Reel® 其它名稱:296-6719-6 |
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