參數(shù)資料
型號： AD9548/PCBZ
廠商： Analog Devices Inc
文件頁數(shù)： 9/112頁
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描述： BOARD EVAL FOR AD9548
產(chǎn)品變化通告： AD9548 Mask Change 20/Oct/2010
設計資源： AD9548 Schematic
AD9548 BOM
AD9548 Eval Brd Layers
標準包裝： 1
主要目的： 計時，時鐘發(fā)生器
嵌入式： 否
已用 IC / 零件： AD9548
主要屬性： 62.5 ~ 450 MHz 輸出頻率
次要屬性： SPI 和 I2C 兼容控制端口
已供物品： 板
AD9548
Data Sheet
Rev. E | Page 106 of 112
Table 154. EEPROM Storage Sequence for End of Data
Address
Bits
Bit Name
Description
0x0E33
[7:0]
End of data
The default value of this register is 0xFF, which the controller interprets as an end
instruction. The controller stores this instruction in the EEPROM, resets the EEPROM
address pointer, and enters an idle state.
0x0E34 to
0x0E3F
Continuation of user
scratch pad area
This area is unused in the default configuration and is available for additional
EEPROM storage sequence commands. Note that the EEPROM storage sequence
must always end with either an end of data or pause command.
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PDF描述
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參數(shù)描述
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