參數(shù)資料
型號： AD9557BCPZ
廠商： Analog Devices Inc
文件頁數(shù)： 45/92頁
文件大?。?/td> 0K
描述： IC CLOCK TRANSLATOR 40LFCSP
產(chǎn)品變化通告： Minor Mask Change 11/Apr/2012
標準包裝： 1
類型： 時鐘/頻率轉(zhuǎn)換器
PLL： 是
主要目的： 以太網(wǎng)，SONET/SDH
輸入： CMOS，LVDS，LVPECL
輸出： CMOS，HSTL，LVDS
電路數(shù)： 1
比率 - 輸入:輸出： 2:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 1.25GHz
電源電壓： 1.71 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 40-VFQFN 裸露焊盤，CSP
供應商設備封裝： 40-LFCSP-VQ（6x6）
包裝： 托盤
Data Sheet
AD9557
Rev. B | Page 5 of 92
POWER DISSIPATION
Table 3.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
POWER DISSIPATION
Typical Configuration
0.36
0.55
0.76
W
System clock: 49.152 MHz crystal; DPLL active;
both 19.44 MHz input references in differential mode;
one HSTL driver at 644.53125 MHz;
one 3.3 V CMOS driver at 161.1328125 MHz and 80 pF
capacitive load on CMOS output
All Blocks Running
0.39
0.61
0.85
W
System clock: 49.152 MHz crystal; DPLL active;
both input references in differential mode;
one HSTL driver at 750 MHz;
two 3.3 V CMOS drivers at 250 MHz and 80 pF capacitive
load on CMOS outputs
Full Power-Down
44
125
mW
Typical configuration with no external pull-up or pull-
down resistors; about 2/3 of this power is on AVDD3
Incremental Power Dissipation
Conditions = typical configuration; table values show the
change in power due to the indicated operation
Input Reference On/Off
Differential Without Divide-by-2
20
25
32
mW
Additional current draw is in the DVDD3 domain only
Differential With Divide-by-2
26
32
40
mW
Additional current draw is in the DVDD3 domain only
Single-Ended Without Divide-by-2
5
7
9
mW
Additional current draw is in the DVDD3 domain only
Output Distribution Driver On/Off
LVDS (at 750 MHz)
12
17
22
mW
Additional current draw is in the AVDD domain only
HSTL (at 750 MHz)
14
21
28
mW
Additional current draw is in the AVDD domain only
1.8 V CMOS (at 250 MHz)
14
21
28
mW
A single 1.8 V CMOS output with an 80 pF load
3.3 V CMOS (at 250 MHz)
18
27
36
mW
A single 3.3 V CMOS output with an 80 pF load
Other Blocks On/Off
Second RF Divider
36
51
64
mW
Additional current draw is in the AVDD domain only
Channel Divider Bypassed
10
17
23
mW
Additional current draw is in the AVDD domain only
LOGIC INPUTS (RESET, SYNC, PINCONTROL, M3 TO M0)
Table 4.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
LOGIC INPUTS (
E
A
,
A
SYNC
EEA
, PINCONTROL
A
)
RESET
Input High Voltage (VIH)
2.1
V
Input Low Voltage (VIL)
0.8
V
Input Current (IINH, IINL)
±50
±100
A
Input Capacitance (CIN)
3
pF
LOGIC INPUTS (M3 to M0)
Input High Voltage (VIH)
2.5
V
Input Level Voltage (VIM)
1.0
2.2
V
Input Low Voltage (VIL)
0.6
V
Input Current (IINH, IINL)
±60
±100
A
Input Capacitance (CIN)
3
pF
相關PDF資料
PDF描述
V375C36M150BG CONVERTER MOD DC/DC 36V 150W
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AD9558BCPZ-REEL7 功能描述:IC CLK XLATR PLL 1250MHZ 64LFCSP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 專用 系列:- 標準包裝:28 系列:- 類型:時鐘/頻率發(fā)生器 PLL:是 主要目的:Intel CPU 服務器 輸入:時鐘 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:3:22 差分 - 輸入:輸出:無/是 頻率 - 最大:400MHz 電源電壓:3.135 V ~ 3.465 V 工作溫度:0°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:64-TFSOP （0.240"，6.10mm 寬） 供應商設備封裝:64-TSSOP 包裝:管件
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