I2C INTERFACE TIMING AND INTERNAL REGISTER DES" />
參數(shù)資料
型號： AD9577BCPZ
廠商： Analog Devices Inc
文件頁數(shù)： 32/44頁
文件大?。?/td> 0K
描述： IC CLK GEN PLL DUAL 40LFCSP
標準包裝： 1
系列： PCI Express® (PCIe)
類型： 扇出緩沖器（分配），網(wǎng)絡(luò)時鐘發(fā)生器，多路復(fù)用器
PLL： 是
主要目的： 以太網(wǎng)，PCI Express（PCIe），SONET/SDH
輸入： 時鐘，晶體
輸出： LVCMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:5
差分 - 輸入:輸出： 無/是
頻率 - 最大： 637.5MHz
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 40-WFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 40-LFCSP-WQ（6x6）
包裝： 托盤
AD9577
Data Sheet
Rev. 0 | Page 38 of 44
I2C INTERFACE TIMING AND INTERNAL REGISTER DESCRIPTION
1
0
X
SLAVE ADDRESS [6:0]
R/W
CTRL
0 = WR
1 = RD
092
84-
0
49
Figure 44. Slave Address Configuration
S SLAVE ADDR, LSB = 0 (WR) A(S)
A(S)
DATA
SUB ADDR
A(S) P
DATA
09284-
050
Figure 45. I2C Write Data Transfer
S
S = START BIT
P = STOP BIT
A(S) = ACKNOWLEDGE BY SLAVE
A(M) = ACKNOWLEDGE BY MASTER
A(M) = LACK OF ACKNOWLEDGE BY MASTER
S
SLAVE ADDR, LSB = 0 (WR)
SLAVE ADDR, LSB = 1 (RD)
A(S)
SUB ADDR
A(S) DATA A(M)
DATA
P
A(M)
09
284-
05
1
Figure 46. I2C Read Data Transfer
START BIT
S
STOP BIT
P
ACK
WR
ACK
D0
D7
A0
A7
A5
A6
SLADDR[4:0]
SLAVE ADDRESS
SUB ADDRESS
DATA
SUB ADDR[6:1]
DATA[6:1]
SCL
SDA
092
84-
05
2
Figure 47. I2C Data Transfer Timing
tBUF
SDA
SS
SCL
tF
tLOW
tR
tF
tHD;STA
tHD;DAT
tSU;DAT
tHIGH
tSU;STA
tSU;STO
tHD;STA
tR
092
84-
05
3
P
S
Figure 48. I2C Port Timing Diagram
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PDF描述
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參數(shù)描述
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