參數(shù)資料
型號(hào)： AD9628BCPZRL7-105
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 32/44頁(yè)
文件大?。?/td> 0K
描述： IC ADC 12BIT 105MSPS 64LFCSP
標(biāo)準(zhǔn)包裝： 750
位數(shù)： 12
采樣率（每秒）： 105M
數(shù)據(jù)接口： LVDS，并聯(lián)，串行，SPI
轉(zhuǎn)換器數(shù)目： 2
電壓電源： 模擬和數(shù)字
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 64-LFCSP-VQ（9x9）
包裝： 帶卷 (TR)
輸入數(shù)目和類型： 4 個(gè)單端，2 個(gè)差分
AD9628
Rev. 0 | Page 38 of 44
Addr
(Hex)
Register
Name
Bit 7
(MSB)
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
(LSB)
Default
Value
(Hex)
Comments
0x1A
User
Pattern 1
MSB
(global)
B15
B14
B13
B12
B11
B10
B9
B8
0x00
User-defined
pattern, 1
MSB
0x1B
User
Pattern 2
LSB (global)
B7
B6
B5
B4
B3
B2
B1
B0
0x00
User-defined
pattern 2
LSBs
0x1C
User
pattern
MSB
B15
B14
B13
B12
B11
B10
B9
B8
0x00
User-defined
pattern, 2
MSBs
0x24
MISR LSB
MISR LSB[7:0]
0xFF
Read only
0x25
MISR MSB
MISR MSB[15:8]
0xFF
Read only
0x2A
Overrange
control
(global)
Open
Overrange
output 0 =
disabled 1 =
enabled
0x01
Overrange
control
settings
0x2E
Output
assign (local)
Open
0 = ADC A
1 = ADC B
(local)
ADC A =
0x00
ADC B =
0x01
Assigns an
ADC to an
output
channel
0x3A
Sync
control
(global)
Open
Clock
divider
next sync
only
Clock
divider
sync
enable
Open
0x00
Sets the
global sync
options
0x100
Sample rate
override
Open
Sample
rate
override
enable
Resolution
100 = 12 bits
110 = 10 bits
Sample rate
011 = 80 MSPS
100 = 105 MSPS
101 = 125 MSPS
0x00
0x101
User I/O
Control
Register 2
Output
Enable
Bar (OEB)
pin
enable
Open
Disable
SDIO pull-
down
0x00
OEB and
SDIO pin
controls
0x102
User I/O
Control
Register 3
Open
VCM power-
down
Open
0x00
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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