參數(shù)資料
型號(hào): AD9787BSVZRL
廠商: Analog Devices Inc
文件頁(yè)數(shù): 38/64頁(yè)
文件大小: 0K
描述: IC DAC 14BIT 800MSPS 100TQFP
產(chǎn)品培訓(xùn)模塊: Data Converter Fundamentals
DAC Architectures
標(biāo)準(zhǔn)包裝: 1,000
系列: TxDAC®
位數(shù): 14
數(shù)據(jù)接口: 串行
轉(zhuǎn)換器數(shù)目: 2
電壓電源: 模擬和數(shù)字
功率耗散(最大): 450mW
工作溫度: -40°C ~ 85°C
安裝類(lèi)型: 表面貼裝
封裝/外殼: 100-TQFP 裸露焊盤(pán)
供應(yīng)商設(shè)備封裝: 100-TQFP-EP(14x14)
包裝: 帶卷 (TR)
輸出數(shù)目和類(lèi)型: 4 電流,單極;4 電流,雙極
采樣率(每秒): 800M
AD9785/AD9787/AD9788
Rev. A | Page 43 of 64
07
09
8-
1
04
NCO PHASE
ACCUMULATOR
RESET
GENERATOR
NCO
Δ
t
SYNC_I
ENABLE
SYNC_I
DELAY [4:0]
EDGE
DETECTOR
CODE
DEMODULATOR
SYNC ERROR
DETECTOR
CLOCK
GENERATION
STATE
LD-STATE
CLOCK
STATE [3:0]
PULSE MODE
ENABLE
PN CODE MODE ENABLE
CORRELATE
THRESHOLD [4:0]
01
SYNC MODE
SELECT
SYNC TIMING
ERROR IRQ
DACCLK
SYNC_I
(PIN 13, PIN 14)
TXENABLE
(PIN 39)
TRANSMIT
PATH
INTERNAL
CLOCKS
Figure 60. Synchronization Receive Circuitry Block Diagram
0
709
8-
1
02
SYSTEM CLOCK
PULSE
GENERATOR
LOW SKEW
CLOCK DRIVER
LOW SKEW
CLOCK DRIVER
MATCHED
LENGTH TRACES
MATCHED
LENGTH TRACES
REFCLK
TXENABLE
SYNC_I
REFCLK
TXENABLE
SYNC_I
OUT
Figure 61. Multichip Synchronization in Pulse Mode
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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AD9788BSVZRL 功能描述:IC DAC 16BIT 800MSPS 100TQFP RoHS:是 類(lèi)別:集成電路 (IC) >> 數(shù)據(jù)采集 - 數(shù)模轉(zhuǎn)換器 系列:TxDAC® 產(chǎn)品培訓(xùn)模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標(biāo)準(zhǔn)包裝:1,000 系列:- 設(shè)置時(shí)間:1µs 位數(shù):8 數(shù)據(jù)接口:串行 轉(zhuǎn)換器數(shù)目:8 電壓電源:雙 ± 功率耗散(最大):941mW 工作溫度:0°C ~ 70°C 安裝類(lèi)型:表面貼裝 封裝/外殼:24-SOIC(0.295",7.50mm 寬) 供應(yīng)商設(shè)備封裝:24-SOIC W 包裝:帶卷 (TR) 輸出數(shù)目和類(lèi)型:8 電壓,單極 采樣率(每秒):*