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參數資料
| 型號： | ADSP-2101BG-100 |
| 廠商： | Analog Devices Inc |
| 文件頁數： | 27/64頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP CONTROLLER 16BIT 68PGA |
| 標準包裝： | 1 |
| 系列： | ADSP-21xx |
| 類型： | 定點 |
| 接口： | 同步串行端口（SSP） |
| 時鐘速率： | 25MHz |
| 非易失內存： | 外部 |
| 芯片上RAM： | 6kB |
| 電壓 - 輸入/輸出： | 5.00V |
| 電壓 - 核心： | 5.00V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 通孔 |
| 封裝/外殼： | 68-BEPGA |
| 供應商設備封裝： | 68-PGA（27.89x27.89） |
| 包裝： | 托盤 |
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ADSP-21xx
REV. B
–33–
Frequency Dependency
(CLKIN
≤ 25 MHz)
Parameter
Min
Max
Unit
Timing Requirement:
tRDD
RD Low to Data Valid
0.5tCK – 13 + w
ns
tAA
A0–A13, PMS, DMS, BMS to Data Valid
0.75tCK – 18 + w
ns
tRDH
Data Hold from RD High
0
Switching Characteristic:
tRP
RD Pulse Width
0.5tCK – 8 + w
ns
tCRD
CLKOUT High to RD Low
0.25tCK – 5
0.25tCK + 10
ns
tASR
A0–A13, PMS, DMS, BMS Setup before
RD Low
0.25tCK – 10
1
ns
tRDA
A0–A13, PMS, DMS, BMS Hold after RD
Deasserted
0.25tCK – 9
ns
tRWR
RD High to RD or WR Low
0.5tCK – 5
ns
NOTES
1For 25 MHz only minimum frequency dependency formula for t
ASR = (0.25tCK – 8.5).
w = wait states
× t
CK.
TIMING PARAMETERS (ADSP-2101/2105/2111/2115/2161/2163)
MEMORY READ
Figure 32. Memory Read
CLKOUT
A0 – A13
D
t
RDA
RD
WR
DMS, PMS
BMS
t
RWR
t
RP
t
ASR
t
CRD
t
RDD
t
AA
t
RDH
13 MHz
13.824 MHz
16.67 MHz
20 MHz
25 MHz
Parameter
Min
Max
Min
Max
Min
Max
Min
Max Min
Max Unit
Timing Requirement:
tRDD
RD Low to Data Valid
23.5
23.2
17
12
7
ns
tAA
A0–A13, PMS, DMS, BMS to Data Valid
37.7
36.2
27
19.5
12
ns
tRDH
Data Hold from RD High
0
ns
Switching Characteristic:
tRP
RD Pulse Width
33.5
28.2
22
17
12
ns
tCRD
CLKOUT High to RD Low
14.2
29.2
13.1
28.1
10
25
7.5
22.5
5
20
ns
tASR
A0–A13, PMS, DMS, BMS Setup before
9.2
8.1
5
2.5
1.5
1
ns
RD Low
tRDA
A0–A13, PMS, DMS, BMS Hold after RD
10.2
9.1
6
3.5
1
ns
Deasserted
tRWR
RD High to RD or WR Low
33.5
31.2
25
20
15
ns
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