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參數(shù)資料
| 型號： | ADSP-2101BG-100 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 40/64頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP CONTROLLER 16BIT 68PGA |
| 標(biāo)準包裝： | 1 |
| 系列： | ADSP-21xx |
| 類型： | 定點 |
| 接口： | 同步串行端口（SSP） |
| 時鐘速率： | 25MHz |
| 非易失內(nèi)存： | 外部 |
| 芯片上RAM： | 6kB |
| 電壓 - 輸入/輸出： | 5.00V |
| 電壓 - 核心： | 5.00V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 通孔 |
| 封裝/外殼： | 68-BEPGA |
| 供應(yīng)商設(shè)備封裝： | 68-PGA（27.89x27.89） |
| 包裝： | 托盤 |
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ADSP-21xx
REV. B
–45–
Frequency
10.24 MHz
Dependency
Parameter
Min
Max
Min
Max
Unit
Timing Requirement:
tCK
CLKIN Period
97.6
150
ns
tCKL
CLKIN Width Low
20
ns
tCKH
CLKIN Width High
20
ns
tRSP
RESET Width Low
488
5tCK
1
ns
Switching Characteristic:
tCPL
CLKOUT Width Low
38.8
0.5tCK – 10
ns
tCPH
CLKOUT Width High
38.8
0.5tCK – 10
ns
tCKOH
CLKIN High to CLKOUT High
0
20
ns
1Applies after powerup sequence is complete. Internal phase lock loop requires no more than 2000 CLKIN cycles assuming stable CLKIN (not including crystal
oscillator startup time).
TIMING PARAMETERS (ADSP-2103/2162/2164)
CLOCK SIGNALS & RESET
Figure 39. Clock Signals
CLKIN
CLKOUT
t
CKH
t
CK
t
CKL
t
CKOH
t
CPH
t
CPL
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VI-B2Z-CX-F4 | CONVERTER MOD DC/DC 2V 30W |
| DSEP30-06BR | DIODE 600V 30A ISOPLUS247 |
| TAJY107M016Y | CAP TANT 100UF 16V 20% 2917 |
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| ADSP-21061LKB-160 | IC DSP CONTROLLER 32BIT 225BGA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ADSP-2101BG-40 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| ADSP-2101BG-50 | 制造商:Analog Devices 功能描述: |
| ADSP-2101BG-66 | 制造商:AD 制造商全稱:Analog Devices 功能描述:ADSP-2100 Family DSP Microcomputers |
| ADSP-2101BG-80 | 制造商:AD 制造商全稱:Analog Devices 功能描述:ADSP-2100 Family DSP Microcomputers |
| ADSP-2101BGZ-100 | 制造商:Analog Devices 功能描述:DSP FIX PT 16BIT 25MHZ 25MIPS 68CPGA - Trays |
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