tIPW tSIR
參數(shù)資料
型號： ADSP-21065LKSZ-240
廠商： Analog Devices Inc
文件頁數(shù)： 7/44頁
文件大小： 0K
描述： IC DSP CONTROLLR 544KBIT 208MQFP
產(chǎn)品培訓(xùn)模塊： SHARC Processor Overview
標(biāo)準(zhǔn)包裝： 1
系列： SHARC®
類型： 浮點
接口： 主機接口，串行端口
時鐘速率： 60MHz
非易失內(nèi)存： 外部
芯片上RAM： 64kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 3.30V
工作溫度： 0°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 208-BFQFP
供應(yīng)商設(shè)備封裝： 208-MQFP（28x28）
包裝： 托盤
其它名稱： ADSP-21065LKSZ240
ADSP-21065LKSZ240-ND
REV. C
ADSP-21065L
–15–
CLKIN
IRQ2-0
tIPW
tSIR
tHIR
Figure 9. Interrupts
Parameter
Min
Max
Unit
Timer
Timing Requirements:
tSTI
Timer Setup Before SDCLK High
0.0
ns
tHTI
Timer Hold After SDCLK High
6.0
ns
Switching Characteristics:
tDTEX
Timer Delay After SDCLK High
1.0
ns
tHTEX
Timer Hold After SDCLK High
–5.0
ns
Parameter
Min
Max
Unit
Flags
Timing Requirements:
tSFI
FLAG11-0IN Setup Before SDCLK High
1
–2.0
ns
tHFI
FLAG11-0IN Hold After SDCLK High
1
6.0
ns
Switching Characteristics:
tDFO
FLAG11-0OUT Delay After SDCLK High
1.0
ns
tHFO
FLAG11-0OUT Hold After SDCLK High
–4.0
ns
tDFOE
SDCLK High to FLAG11-0OUT Enable
–4.0
ns
tDFOD
SDCLK High to FLAG11-0OUT Disable
–1.75
ns
NOTE
1Flag inputs meeting these setup and hold times will affect conditional instructions in the following instruction cycle.
SDCLK
FLAG11–0OUT
FLAG OUTPUT
tDFO
tHFO
tDFO
tDFOD
tDFOE
SDCLK
tSFI
tHFI
FLAG11–0IN
Figure 10. Flags
相關(guān)PDF資料
PDF描述
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參數(shù)描述
ADSP-21065LKSZ-264 功能描述:IC DSP CONTROLL 544KBIT 208-MQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - DSP（數(shù)字式信號處理器） 系列:SHARC® 標(biāo)準(zhǔn)包裝:40 系列:TMS320DM64x, DaVinci™ 類型:定點 接口:I²C，McASP，McBSP 時鐘速率:400MHz 非易失內(nèi)存:外部 芯片上RAM:160kB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:0°C ~ 90°C 安裝類型:表面貼裝 封裝/外殼:548-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:548-FCBGA（27x27） 包裝:托盤 配用:TMDSDMK642-0E-ND - DEVELPER KIT W/NTSC CAMERA296-23038-ND - DSP STARTER KIT FOR TMS320C6416296-23059-ND - FLASHBURN PORTING KIT296-23058-ND - EVAL MODULE FOR DM642TMDSDMK642-ND - DEVELOPER KIT W/NTSC CAMERA
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