參數(shù)資料
型號(hào)： ADSP-2185LBSTZ-210
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 16/48頁(yè)
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 16BIT 100LQFP
標(biāo)準(zhǔn)包裝： 1
系列： ADSP-21xx
類型： 定點(diǎn)
接口： 主機(jī)接口，串行端口
時(shí)鐘速率： 52MHz
非易失內(nèi)存： 外部
芯片上RAM： 80kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 3.30V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP
供應(yīng)商設(shè)備封裝： 100-LQFP（14x14）
包裝： 托盤(pán)
ADSP-2184L/ADSP-2185L/ADSP-2186L/ADSP-2187L
Rev. C
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January 2008
Clock Signals and Reset
Table 14. Clock Signals and Reset
ADSP-2184L, ADSP-2186L
ADSP-2185L, ADSP-2187L
Parameter
Min
Max
Min
Max
Unit
Timing Requirements:
tCKI
CLKIN Period
50
150
38
100
ns
tCKIL
CLKIN Width Low
20
15
ns
tCKIH
CLKIN Width High
20
15
ns
Switching Characteristics:
tCKL
CLKOUT Width Low
0.5tCK – 7
ns
tCKH
CLKOUT Width High
0.5tCK – 7
ns
tCKOH
CLKIN High to CLKOUT High
0
20
0
20
ns
Control Signals Timing Requirements:
tRSP
RESET Width Low
1
5tCK
ns
tMS
Mode Setup Before RESET High
2
ns
tMH
Mode Hold After RESET High
5
ns
1 Applies after power-up sequence is complete. Internal phase lock loop requires no more than 2000 CLKIN cycles, assuming stable CLKIN (not including crystal oscillator
start-up time).
Figure 16. Clock Signals and Reset
tCKOH
tCKI
tCKIH
tCKIL
tCKH
tCKL
tMH
tMS
CLKIN
CLKOUT
MODE A D
RESET
tRSP
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