Timing Requirements: t
參數(shù)資料
型號(hào)： ADSP-2189MKSTZ-300
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 11/32頁(yè)
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 16BIT 100-LQFP
標(biāo)準(zhǔn)包裝： 1
系列： ADSP-21xx
類型： 定點(diǎn)
接口： 主機(jī)接口，串行端口
時(shí)鐘速率： 75MHz
非易失內(nèi)存： 外部
芯片上RAM： 192kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 2.50V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP
供應(yīng)商設(shè)備封裝： 100-LQFP（14x14）
包裝： 托盤
其它名稱： ADSP-2189MKSTZ300
ADSP-2189MKSTZ300-ND
REV. A
ADSP-2189M
–19–
TIMING PARAMETERS
Parameter
Min
Max
Unit
Clock Signals and Reset
Timing Requirements:
tCKI
CLKIN Period
26.6
80
ns
tCKIL
CLKIN Width Low
13
ns
tCKIH
CLKIN Width High
13
ns
Switching Characteristics:
tCKL
CLKOUT Width Low
0.5tCK – 2ns
tCKH
CLKOUT Width High
0.5tCK – 2ns
tCKOH
CLKIN High to CLKOUT High
0
13
ns
Control Signals
Timing Requirements:
tRSP
RESET Width Low
5tCK
1
ns
tMS
Mode Setup before
RESET High
2
ns
tMH
Mode Hold after
RESET High
5
ns
NOTE
1Applies after power-up sequence is complete. Internal phase lock loop requires no more than 2000 CLKIN cycles assuming stable CLKIN (not including crystal
oscillator start-up time).
tCKOH
tCKI
tCKIH
tCKIL
tCKH
tCKL
tMH
tMS
CLKIN
CLKOUT
PF(3:0)
*
RESET
*PF3 IS MODE D, PF2 IS MODE C, PF0 IS MODE A
Figure 22. Clock Signals
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PDF描述
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