Timing Requirements: tIALP Dura" />
參數(shù)資料
型號(hào)： ADSP-2189MKSTZ-300
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 18/32頁(yè)
文件大小： 0K
描述： IC DSP CONTROLLER 16BIT 100-LQFP
標(biāo)準(zhǔn)包裝： 1
系列： ADSP-21xx
類型： 定點(diǎn)
接口： 主機(jī)接口，串行端口
時(shí)鐘速率： 75MHz
非易失內(nèi)存： 外部
芯片上RAM： 192kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 2.50V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP
供應(yīng)商設(shè)備封裝： 100-LQFP（14x14）
包裝： 托盤
其它名稱： ADSP-2189MKSTZ300
ADSP-2189MKSTZ300-ND
REV. A
ADSP-2189M
–25–
Parameter
Min
Max
Unit
IDMA Address Latch
Timing Requirements:
tIALP
Duration of Address Latch
1, 2
10
ns
tIASU
IAD15–0 Address Setup before Address Latch End
2
5ns
tIAH
IAD15–0 Address Hold after Address Latch End
2
3ns
tIKA
IACK Low before Start of Address Latch2, 3
0ns
tIALS
Start of Write or Read after Address Latch End
2, 3
3ns
tIALD
Address Latch Start after Address Latch End
1, 2
2ns
NOTES
1Start of Address Latch =
IS Low and IAL High.
2End of Address Latch =
IS High or IAL Low.
3Start of Write or Read =
IS Low and IWR Low or IRD Low.
IACK
IAL
IS
IAD15–0
RD OR WR
tIKA
tIALP
tIALD
tIASU
tIAH
tIASU
tIALS
tIAH
tIALP
Figure 28. IDMA Address Latch
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PDF描述
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XC2C384-10FGG324C IC CR-II CPLD 384MCELL 324-FBGA
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