參數(shù)資料
型號(hào)： ADSP-BF548MBBCZ-5M
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 91/100頁(yè)
文件大?。?/td> 0K
描述： IC DSP 533MHZ W/DDR 400CSPBGA
標(biāo)準(zhǔn)包裝： 1
系列： Blackfin®
類型： 定點(diǎn)
接口： CAN，SPI，SSP，TWI，UART，USB
時(shí)鐘速率： 533MHz
非易失內(nèi)存： 外部
芯片上RAM： 260kB
電壓 - 輸入/輸出： 2.50V，3.30V
電壓 - 核心： 1.25V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 400-LFBGA，CSPBGA
供應(yīng)商設(shè)備封裝： 400-CSPBGA（17x17）
包裝： 托盤
配用： ADSP-3PARCBF548M01-ND - MODULE BOARD BF548
ADSP-3PARCBF548E02-ND - KIT DEV STARTER BF548
Rev. C
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February 2010
ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
Figure 78. Typical Rise and Fall Times (10% to 90%) vs. Load Capacitance for
Driver C at VDDEXT = 2.25 V
Figure 79. Typical Rise and Fall Times (10% to 90%) vs. Load Capacitance for
Driver C at VDDEXT = 3.65 V
Figure 80. Typical Rise and Fall Times (10% to 90%) vs. Load Capacitance for
Driver D DDR SDRAM at VDDDDR= 2.5V
LOAD CAPACITANCE (pF)
RISE TIME
RISE
AND
F
ALL
TIME
ns
(10%
to
90%) 25
30
20
15
10
5
0
50
100
150
200
250
FALL TIME
LOAD CAPACITANCE (pF)
RISE TIME
RISE
AND
F
ALL
TIME
ns
(10%
to
90%)
20
18
16
14
12
10
8
6
4
2
0
50
100
150
200
250
FALL TIME
LOAD CAPACITANCE (pF)
RISE/FALL TIME
RISE
AND
F
ALL
TIME
ns
(10%
to
90%)
5
6
4
3
2
1
0
010
20
30
40
50
60
70
Figure 81. Typical Rise and Fall Times (10% to 90%) vs. Load Capacitance for
Driver D DDR SDRAM at VDDDDR= 2.7V
Figure 82. Typical Rise and Fall Times (10% to 90%) vs. Load Capacitance for
Driver D Mobile DDR SDRAM at VDDDDR = 1.8V
Figure 83. Typical Rise and Fall Times (10% to 90%) vs. Load Capacitance for
Driver D Mobile DDR SDRAM at VDDDDR = 1.95V
LOAD CAPACITANCE (pF)
RISE/FALL TIME
RISE
AND
F
ALL
TIME
ns
(10%
to
90%) 5
6
4
3
2
1
0
010
20
30
40
70
50
60
LOAD CAPACITANCE (pF)
RISE/FALL TIME
RISE
AND
F
ALL
TIME
ns
(10%
to
90%)
2.5
3
2
1.5
1
.5
0
010
20
30
40
50
60
70
3.5
4
LOAD CAPACITANCE (pF)
RISE/FALL TIME
RISE
AND
F
ALL
TIME
ns
(10%
to
90%)
2.5
3
2
1.5
1
.5
0
010
20
30
40
50
60
70
3.5
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