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參數(shù)資料
| 型號(hào)： | ADV7189BKSTZ |
| 廠商： | Analog Devices Inc |
| 文件頁(yè)數(shù)： | 84/104頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC DECODER VIDEO W/ADC 80LQFP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | 視頻解碼器 |
| 應(yīng)用： | 機(jī)頂盒，視頻播放器，錄音機(jī) |
| 電壓 - 電源，模擬： | 3.15 V ~ 3.45 V |
| 電壓 - 電源，數(shù)字： | 1.65 V ~ 2 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 80-LQFP |
| 供應(yīng)商設(shè)備封裝： | 80-LQFP（14x14） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁(yè)面： | 788 (CN2011-ZH PDF) |
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ADV7189B
Rev. B | Page 80 of 104
Bits
Subaddress
Register
Bit Description
7
6
5
4
3
2
1
0
Comments
Notes
HSE[10:8]. HS end allows the
positioning of the HS output within
the video line.
0
HS output ends HSE[10:0]
pixels after the falling
edge of Hsync
Reserved
0
Set to 0
HSB[10:8]. HS begin allows the
positioning of the HS output within
the video line.
0
HS output starts HSB[10:0]
pixels after the falling
edge of Hsync
0x34
HS Position
Control 1
Reserved
0
Set to 0
0x35
HS Position
Control 2
HSB[7:0] See above, using
HSB[10:0] and HSE[10:0], the user
can program the position and
length of HS output signal.
0
1
0
0x36
HS Position
Control 3
HSE[7:0] See above.
0
Using HSB and HSE
the user can program
the position and
length of the output
Hsync
0
Invert polarity
PCLK. Sets the polarity of LLC1.
1
Normal polarity as per
timing diagrams
Reserved
0
Set to 0
0
Active high
PF. Sets the FIELD polarity.
1
Active low
Reserved
0
Set to 0
0
Active high
PVS. Sets the VS polarity.
1
Active low
Reserved
0
Set to 0
0
Active high
0x37
Polarity
PHS. Sets HS polarity.
1
Active low
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