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參數(shù)資料
| 型號： | AT80C51RD2-SLSUM |
| 廠商： | Atmel |
| 文件頁數(shù)： | 28/81頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC 8051 MCU 5V SPI 20MHZ 44-PLCC |
| 標準包裝： | 972 |
| 系列： | 80C |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 40MHz |
| 連通性： | UART/USART |
| 外圍設(shè)備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 32 |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 1K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 44-PLCC |
| 包裝： | 管件 |
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4113D–8051–01/09
AT80C51RD2
11. Serial I/O Port
The serial I/O port in the AT80C51RD2 is compatible with the serial I/O port in the 80C52.
It provides both synchronous and asynchronous communication modes. It operates as a Univer-
sal Asynchronous Receiver and Transmitter (UART) in three full-duplex modes (Modes 1, 2 and
3). Asynchronous transmission and reception can occur simultaneously and at different baud
rates
Serial I/O port includes the following enhancements:
Framing error detection
Automatic address recognition
11.1
Framing Error Detection
Framing bit error detection is provided for the three asynchronous modes (modes 1, 2 and 3). To
enable the framing bit error detection feature, set SMOD0 bit in PCON register (see Figure 11-
1).
Figure 11-1. Framing Error Block diagram
When this feature is enabled, the receiver checks each incoming data frame for a valid stop bit.
An invalid stop bit may result from noise on the serial lines or from simultaneous transmission by
two CPUs. If a valid stop bit is not found, the Framing Error bit (FE) in SCON register (see Table
11-4) bit is set.
Software may examine FE bit after each reception to check for data errors. Once set, only soft-
ware or a reset can clear FE bit. Subsequently, received frames with valid stop bits cannot clear
FE bit. When FE feature is enabled, RI rises on stop bit instead of the last data bit (see Figure
11-2 and Figure 11-3).
Figure 11-2. UART Timings in Mode 1
RI
TI
RB8
TB8
RE N
SM 2
SM 1
SM 0/FE
IDL
PD
GF0
GF1
PO F
-
SM OD0
SM OD1
To UA RT fra min g e rro r co nt ro l
SM 0 to UA RT m o de con tro l (SM OD0 = 0 )
Se t FE bit if stop bit is 0 (fram ing erro r) (SM OD0 = 1)
SCO N (9 8h )
PCON (87 h)
1
Data byte
RI
SMOD0=X
Stop
bit
Start
bit
RXD
D7
D6
D5
D4
D3
D2
D1
D0
FE
SMOD0=1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AT89LP51-20MU | MCU 8051 4K FLASH 20MHZ 7X7MLF |
| AT80C51RD2-RLTUM | IC 8051 MCU 5V SPI 20MHZ 44-VQFP |
| AT89S52-24JU | IC MCU 8K FLASH 24MHZ 44-PLCC |
| AT89S52-24PU | IC MCU 8K FLASH 24MHZ 40-DIP |
| 200875-1 | CONN FIXED JACKSCREW FMLE W/HDWR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AT80C51SND1C | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Single-Chip Flash Microcontroller with MP3 Decoder and Human Interface |
| AT80C51SND1C-7HTIL | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Single-Chip Flash Microcontroller with MP3 Decoder and Guman Interface |
| AT80C51SND1C-7HTJL | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Single-Chip Flash Microcontroller with MP3 Decoder and Human Interface |
| AT80C51SND1C-DDV | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Single-Chip Flash Microcontroller with MP3 Decoder and Guman Interface |
| AT80C51SND1C-ROTIL | 功能描述:IC MCU FLASH MP3 DECODER 80-TQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:80C 標準包裝:1,500 系列:AVR® ATtiny 核心處理器:AVR 芯體尺寸:8-位 速度:16MHz 連通性:I²C，LIN，SPI，UART/USART，USI 外圍設(shè)備:欠壓檢測/復位，POR，PWM，溫度傳感器，WDT 輸入/輸出數(shù):16 程序存儲器容量:8KB（4K x 16） 程序存儲器類型:閃存 EEPROM 大小:512 x 8 RAM 容量:512 x 8 電壓 - 電源 (Vcc/Vdd):2.7 V ~ 5.5 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 11x10b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 125°C 封裝/外殼:20-SOIC（0.295"，7.50mm 寬） 包裝:帶卷 (TR) |
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