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參數(shù)資料
| 型號(hào)： | C161U |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | Embedded C166 with USB, USART and SSC |
| 中文描述： | 嵌入式的C166使用USB，USART和南南合作 |
| 文件頁(yè)數(shù)： | 347/469頁(yè) |
| 文件大小： | 7055K |
| 代理商： | C161U |
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C161U
USB Interface Controller
Data Sheet
347
2001-04-19
for non-Iso-transfers: if fhe transfer was ACK’d, the next packet can be set up for
transmission, otherwise, host expects the same data to be resent
SW must set up again the EPEC source-, destination-pointer and packetlength and
start the transfer
If SW has already set up data in a tx-fifo and now, e.g. host changes the configuration
or interfaces, SW can use a write into the command-register to flush the fifo of the
corresponding endpoint. Before doing this, the EPEC-channel must be disabled or
reprorgammed, otherwise the next pending bytes will be transferred into the tx-fifo.
15.7.3
Out-Transfer (Receive)
During an Out-transfer, host is transferring data to the device. SW must provide an free
memory-block for each endpoint and set up the EPEC for moving arriving data from the
USB-block to a free memory-location.
SW provides an free memory-block and sets up source- (usbd_rxrr-registerX),
destination-pointer (free memory-block) and packet lenght of the EPEC and sets the
TXR_ENAx bit (refer to Table 18, “EPEC_CTRL_REGx Source Pointer Register,” on
page 101); the packetlength supported by the EPEC must always be an even number
of bytes (in receive-direction the EPEC only does word-transfers) and have at least
space for the maxpacketlength of the endpoint.
when host sends data, it is forwarded through the fifo’s and with every transferred
word that can be read from usbd_rxrr-registerX the usbd_rxrr-interruptX is set (for
normal functionality this can be ignored); EPEC transferes this data into the memory
EPEC generates an EPEC-interrupt when it has transferred all the data into the
memory (this interrupt is generated shortly after the USB-block has generated the
udc_rx_done-interrupt); SW must read the EPEC-interrupt-register and clear the (to
the endpoint) corresponding bit in this register by writing a ‘1’ into it
when USB-block has finished the whole transfer, it generates the udc_rx_done-
interrupt; SW must then read the usbd_rx_bytecnt-register, in order to determine the
number of bytes of the received packet and to release the interlocking of the fifo for
the next transfer; the most significant bit in this register contains also the status-bit of
the status-register and shows whether this packet had transmission-errors or not
if host has sent a packet of zero lenght, no rxrr-interrupt is generated but only a
rx_done-interrupt; here also SW must read the rxbytecountX-register
in order to prepare a receive on this endpoint again SW must provide a new free
memory-block, set up the source-, destination-pointer and packetlength of the EPEC
and write the start-bit
15.7.4
Reading out Setup-Packets
Setup-packets are treated without the EPEC. If host sends a setup-packet which is
forwarded to the CPU (there are only three commands: get_descriptor, set_descriptor
and synch_frame all the other ones are treated internally), and the packet is valid, the
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| C161 | 16-Bit Single-Chip Microcontroller |
| C163-L | 16-bit CMOS Single-Chip Microcontroller |
| C164CI-8E | 16-bit microcontrollers(16位微控制器) |
| C164CI | 16-bit CMOS Single-Chip Microcontroller |
| C164CL | 16-Bit Single-Chip Microcontroller |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| C161U_02 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:Embedded C166 with USB, USART and SSC SAF C161U-LF, Version 1.3 |
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| C161V_96 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:16-Bit CMOS Single-Chip Microcontrollers |
| C162 | 制造商:TE CONNECTIVITY 功能描述:AMP1658614-3 & AMP747275-3 CONN & STR RLF BULK PKG |
| C162 BK088 | 制造商:Alpha Wire Company 功能描述:LACING TAPE POLY WAX BLACK 500' |
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