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參數(shù)資料
| 型號： | C163-L |
| 廠商： | SIEMENS AG |
| 英文描述： | 16-bit CMOS Single-Chip Microcontroller |
| 中文描述： | 16位CMOS單片機 |
| 文件頁數(shù)： | 58/68頁 |
| 文件大小： | 625K |
| 代理商： | C163-L |
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11Aug98@14:48h Intermediate Version
Semiconductor Group
56
1998-08
C163-L
AC Characteristics
CLKOUT and READY
(Reduced Supply Voltage Range)
(Operating Conditions apply,
C
L
= 100 pF)
1) These timings are given for test purposes only, in order to assure recognition at a specific clock edge.
2) Demultiplexed bus is the worst case. For multiplexed bus 2TCL are to be added to the maximum values. This
adds even more time for deactivating READY.
The 2t
A
and t
C
refer to the next following bus cycle, t
F
refers to the current bus cycle.
Parameter
Symbol
Max. CPU Clock
= 12 MHz
Variable CPU Clock
1 / 2TCL = 1 to 12 MHz
Unit
min.
max.
min.
max.
CLKOUT cycle time
t
29
t
30
t
31
CC 83
CC 22
CC 26
83
2TCL
2TCL
ns
CLKOUT high time
–
TCL – 20
–
ns
CLKOUT low time
–
TCL – 16
–
ns
CLKOUT rise time
t
32
t
33
t
34
CC –
16
–
16
ns
CLKOUT fall time
CC –
CC -6 +
t
A
10
6 +
t
A
–
-6 +
t
A
10
6 +
t
A
ns
CLKOUT rising edge to
ALE falling edge
ns
Synchronous READY
setup time to CLKOUT
t
35
SR 20
–
20
–
ns
Synchronous READY
hold time after CLKOUT
t
36
SR 0
–
0
–
ns
Asynchronous READY
low time
t
37
SR 103
–
2TCL + 20
–
ns
Asynchronous READY
setup time
1)
t
58
SR 20
–
20
–
ns
Asynchronous READY
hold time
1)
t
59
SR 0
–
0
–
ns
Async. READY hold time
after RD, WR high
(Demultiplexed Bus)
2)
t
60
SR 0
16
+ 2
t
A
+
t
C
+
t
F
2)
0
TCL - 26
+
2
t
A
+
t
C
+
t
F
2)
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| C164CI-8E | 16-bit microcontrollers(16位微控制器) |
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| C164SI | 16-Bit Single-Chip Microcontroller |
| C164SL | 16-Bit Single-Chip Microcontroller |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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