參數(shù)資料
型號： C5NPD0-DS
英文描述： QUAD BILATERAL SWITCH FOR TRANSMISSION OR MULTIPLEXING OF ANALOG OR DIGITAL SIGNALS
中文描述： 的C - 5網(wǎng)絡處理器的數(shù)據(jù)資料硅修訂D0
文件頁數(shù)： 85/100頁
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代理商： C5NPD0-DS
AC Timing Specifications
85
MOTOROLA GENERAL BUSINESS INFORMATION
C5NPD0-DS/D REV 04
Fabric Processor Timing
Specifications
The FP timing specifications are shown in
Figure 22
and described in
Table 50
.
Figure 22
Fabric Processor Timing Diagram
FRXCLK
Cycle 1
Cycle 2
Cycle 3
Cycle 4
Cycle 5
FRXCTL
(output)
FRXCTL
(input)
FINn
T
frc
T
frco
T
frcv
T
frcz
T
frcs
T
frch
T
frds
T
frdh
T
ftcs
T
ftch
FTXCLK
FTXCTL
(output)
FTXCTL
(input)
FOUTn
T
ftc
T
ftco
T
ftcv
T
ftcz
T
ftdo
Table 50
Fabric Processor Timing Description
SYMBOL
PARAMETER
MIN
TYP
MAX
UNIT
COMMENT
Tfrc
FRX Cycle Time
9.0
ns
Tfrcs
FRXCTL Setup
4.0
1.5
ns
Utopia2 Mode
All other modes
Tfrch
FRXCTL Hold
0.5
ns
F
n
.
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PDF描述
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