參數(shù)資料
型號(hào)： CDB4351
廠商： Cirrus Logic Inc
文件頁(yè)數(shù)： 15/37頁(yè)
文件大小： 0K
描述： BOARD EVAL FOR CS4351 DAC
標(biāo)準(zhǔn)包裝： 1
系列： Popguard®
DAC 的數(shù)量： 2
位數(shù)： 24
采樣率（每秒）： 192k
數(shù)據(jù)接口： 串行
DAC 型： 電壓
工作溫度： -10°C ~ 70°C
已供物品： 板，纜線，CD
已用 IC / 零件： CS4351
產(chǎn)品目錄頁(yè)面： 757 (CN2011-ZH PDF)
相關(guān)產(chǎn)品： CS4351-DZZ-ND - IC DAC STER 112DB 192KHZ 20TSSOP
598-1055-5-ND - IC DAC STER 112DB 192KHZ 20TSSOP
其它名稱： 598-1152
22
DS566F1
CS4351
4. Write the desired data to the register pointed to by the MAP.
5. If the INCR bit (see Section 4.9.1) is set to 1, repeat the previous step until all the desired registers
are written, then bring CS high.
6. If the INCR bit is set to 0 and further SPI writes to other registers are desired, it is necessary to bring
CS high, and follow the procedure detailed from step 1. If no further writes to other registers are de-
sired, bring CS high.
)
4.10
Memory Address Pointer (MAP)
4.10.1
INCR (AUTO MAP INCREMENT ENABLE)
Default = ‘0’
0 - Disabled
1 - Enabled
4.10.2
MAP (MEMORY ADDRESS POINTER)
Default = ‘0000’
76543210
INCR
Reserved
MAP3
MAP2
MAP1
MAP0
00000000
MAP
MSB
LSB
DATA
byte 1
byte n
R/W
MAP = Mem ory Address Pointer
ADDRESS
CHIP
CDIN
CC LK
CS
1001100
Figure 10. Control Port Timing, SPI mode
相關(guān)PDF資料
PDF描述
VI-B11-EY CONVERTER MOD DC/DC 12V 50W
GMA10DRMD-S288 CONN EDGECARD 20POS .125 EXTEND
GBM28DCWI CONN EDGECARD 56POS DIP .156 SLD
STD03W-R WIRE & CABLE MARKERS
AD9739A-FMC-EBZ BOARD EVAL W/FMC CONN FPGA DEV
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參數(shù)描述
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