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參數(shù)資料
| 型號(hào)： | CY39200V208-181NTXC |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | LOADABLE PLD, 8.5 ns, PQFP208 |
| 封裝： | 28 X 28 MM, 0.50 MM PITCH, LEAD FREE, PLASTIC, EQFP-208 |
| 文件頁數(shù)： | 38/86頁 |
| 文件大?。?/td> | 2802K |
| 代理商： | CY39200V208-181NTXC |
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Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *I
Page 43 of 86
Package Diagrams (continued)
A
22
0.10(4X)
0.60±0.10(484X)
0.25 MCAB
0.05 M C
A1 CORNER
B
C
D
E
F
G
H
J
K
L
M
N
P
R
T
U
V
W
Y
AA
AB
21
20
19
18
17
16
15
14
13
12
11
10 98 76 54 3 2 1
21.00
Y
U
V
T
R
M
P
N
L
K
G
J
H
F
E
B
D
C
A
AA
AB
W
22
15
19
20
21
17
18
16
12
14
13
10
11
9
57 8
6
4
23
1
1.00
21.00
1.00
A1 CORNER
0.25
C
SEATING PLANE
C
0.20
C
TOP VIEW
BOTTOM VIEW
23.00±0.10
0.56
0.50±0.10
1.90
MAX
A
B
10.50
0.70±0.05
484-ball FBGA (23 mm x 23 mm x 1.6 mm) BB484
51-85124-*D
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY39200V208-83NTXC | LOADABLE PLD, 15 ns, PQFP208 |
| CY54FCT2240ATLM | FCT SERIES, DUAL 4-BIT DRIVER, INVERTED OUTPUT, CQCC20 |
| CY54FCT257TDMB | FCT SERIES, QUAD 2 LINE TO 1 LINE MULTIPLEXER, TRUE OUTPUT, CDIP16 |
| CY62126DV30L-55ZSE | 64K X 16 STANDARD SRAM, 55 ns, PDSO44 |
| CY62126DV30LL-70ZIT | 64K X 16 STANDARD SRAM, 70 ns, PDSO44 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY39200V208-200BBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200V208-200BBI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200V208-200BGC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200V208-200BGI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200V208-200MBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
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