參數(shù)資料
型號(hào)： DS21Q55DK
英文描述： Quad T1/E1/J1 Transceiver Design Kit Daughter Card
中文描述： 四路T1/E1/J1收發(fā)器開(kāi)發(fā)板子卡
文件頁(yè)數(shù)： 80/99頁(yè)
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代理商： DS21Q55DK
DS21Q50
Page 80 of 99
Figure 22-4 RECEIVE INTERLEAVE BUS OPERATION
RSYNC
Notes:
1. 4.096 MHz bus configuration.
2. 8.192 MHz bus configuration.
3. RSYNC is in the input mode (RCR.5 = 0).
RSER
LSB
SYSCLK
RSYNC
FRAMER 3, CHANNEL 32
MSB
LSB
FRAMER 0, CHANNEL 1
MSB
LSB
FRAMER 1, CHANNEL 1
3
RSER
RSER
FR2 CH32 FR3 CH32
FR0 CH1
FR1 CH1
FR2 CH1
FR3 CH1
FR0 CH2
FR1 CH2
FR2 CH2
FR3 CH2
1
2
BIT DETAIL
FR1 CH32
FR0 CH1
FR1 CH1
FR0 CH2
FR1 CH2
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