參數(shù)資料
型號： DS3172N+
廠商： Maxim Integrated Products
文件頁數(shù)： 98/234頁
文件大?。?/td> 0K
描述： IC TXRX DS3/E3 DUAL 400-BGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 4
功能： 單芯片收發(fā)器
接口： DS3，E3
電路數(shù)： 2
電源電壓： 3.135 V ~ 3.465 V
電流 - 電源： 328mA
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 400-BBGA
供應(yīng)商設(shè)備封裝： 400-PBGA（27x27）
包裝： 管件
包括： DS3 調(diào)幀器，E3 調(diào)幀器，HDLC 控制器，芯片內(nèi) BERT
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DS3171/DS3172/DS3173/DS3174
187
12.9.3 Transmit G.751 E3
The transmit G.751 E3 utilizes two registers.
12.9.3.1 Register Map
Table 12-25. Transmit G.751 E3 Framer Register Map
Address
Register
Register Description
(1,3,5,7)18h E3G751.TCR
E3 G.751 Transmit Control Register
(1,3,5,7)1Ah E3G751.TEIR
E3 G.751 Transmit Error Insertion Register
(1,3,5,7)1Ch
--
Reserved
(1,3,5,7)1Eh
--
Reserved
12.9.3.2 Register Bit Descriptions
Register Name:
E3G751.TCR
Register Description:
E3 G.751 Transmit Control Register
Register Address:
(1,3,5,7)18h
Bit #
15
14
13
12
11
10
9
8
Name
Reserved
--
Reserved
TNBC1
TNBC0
Default
0
Bit #
7
6
5
4
3
2
1
0
Name
--
Reserved
TABC1
TABC0
TFGC
TAIS
Default
0
Bits 9 to 8: Transmit N Bit Control (TNBC[1:0]) – These two bits control the source of the N bit.
00 = 1
01 = transmit data from HDLC controller.
10 = transmit data from FEAC controller.
11 = 0
Note: If TNBC[1:0] is 10 and TABC[1:0] is 01, both the N bit and A bit will carry the same transmit FEAC controller
(one bit per frame period), however, the N bit and A bit in the same frame may or may not be equal.
Bits 3 to 2: Transmit A Bit Control (TABC[1:0]) – These two bits control the source of the A bit.
00 = automatically generated based upon received E3 alarms.
01 = transmit from the FEAC controller.
10 = 0
11 = 1
Note: If TABC[1:0] is 01 and TNBC[1:0] is 10, both the A bit and N bit will carry the same transmit FEAC controller
(one bit per frame period), however, the A bit and N bit in the same frame may or may not be equal.
Bit 1: Transmit Frame Generation Control (TFGC) – When this bit is zero, the Transmit Frame Processor frame
generation is enabled. The E3 overhead positions in the incoming E3 payload will be overwritten with the internally
generated E3 overhead. When this bit is one, the Transmit Frame Processor frame generation is disabled. The E3
overhead positions in the incoming E3 payload will be passed through to error insertion. Note: The E3 overhead
periods can still be overwritten by overhead insertion.
Bit 0: Transmit Alarm Indication Signal (TAIS) – When 0, the normal signal is transmitted. When 1, the output
E3 data stream is forced to all ones (AIS).
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DS3173N 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Triple DS3/E3 Single Chip Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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