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參數(shù)資料
| 型號： | DSP56367UM |
| 廠商： | 飛思卡爾半導體(中國)有限公司 |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 24-Bit Audio Digital Signal Processor |
| 中文描述： | 24位音頻數(shù)字信號處理器 |
| 文件頁數(shù)： | 61/100頁 |
| 文件大小： | 1039K |
| 代理商： | DSP56367UM |
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Serial Host Interface SPI Protocol Timing
DSP56367 Technical Data, Rev. 2.1
Freescale Semiconductor
3-37
Figure 3-26 Host DMA Read Timing Diagram
3.12
Serial Host Interface SPI Protocol Timing
Table 3-16 Serial Host Interface SPI Protocol Timing
No.
Characteristics
1
Mode
Filter
Mode
Expression
2
Min
Max
Unit
140
Tolerable spike width on clock or data in
—
Bypassed
Narrow
Wide
—
—
—
—
—
—
0
50
100
ns
141
Minimum serial clock cycle =
t
SPICC
(min)
Master
Bypassed
Narrow
Wide
6
×
TC+46
6
×
T
C
+152
6
×
T
C
+223
86.2
192.2
263.2
—
—
—
ns
142
Serial clock high period
Master
Bypassed
Narrow
Wide
0.5
×
t
SPICC
–10
0.5
×
t
SPICC
–10
0.5
×
t
SPICC
–10
38
91
126.5
—
—
—
ns
Slave
Bypassed
Narrow
Wide
2.5
×
T
C
+ 12
2.5
×
T
C
+ 102
2.5
×
T
C
+ 189
28.8
118.8
205.8
—
—
—
ns
143
Serial clock low period
Master
Bypassed
Narrow
Wide
0.5
×
t
SPICC
–10
0.5
×
t
SPICC
–10
0.5
×
t
SPICC
–10
38
—
ns
Slave
Bypassed
Narrow
Wide
2.5
×
T
C
+ 12
2.5
×
T
C
+ 102
2.5
×
T
C
+ 189
28.8
118.8
205.8
—
—
—
ns
326
317
318
327
328
329
Data
Valid
HOREQ
(Output)
HACK
(Input)
H0-H7
(Output)
RXH
Read
343
342
342
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PDF描述 |
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參數(shù)描述 |
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