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參數(shù)資料
| 型號： | DSP56F801 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | 16-bit Hybrid Controller(16位混合控制器) |
| 中文描述： | 16位混合控制器（16位混合控制器） |
| 文件頁數(shù)： | 31/44頁 |
| 文件大?。?/td> | 858K |
| 代理商： | DSP56F801 |
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Quad Timer Timing
56F801 Technical Data
31
3.8 Quad Timer Timing
3.9 Serial Communication Interface (SCI) Timing
Table 27. SCI Timing
4
Operating Conditions:
V
SS
= V
SSA
= 0 V, V
DD
= V
DDA
= 3.0–3.6 V, T
A
= –40
°
to +85
°
C, C
L
≤
50pF
Table 26. Timer Timing
1, 2
Operating Conditions:
V
SS
= V
SSA
= 0 V, V
DD
= V
DDA
= 3.0–3.6 V, T
A
= –40
°
to +85
°
C, C
L
≤
50pF
1.
2.
In the formulas listed, T = clock cycle. For 80MHz operation, T = 12.5ns.
Parameters listed are guaranteed by design.
Characteristic
Symbol
Min
Max
Unit
Timer input period
P
IN
4T+6
—
ns
Timer input high/low period
P
INHL
2T+3
—
ns
Timer output period
P
OUT
2T
—
ns
Timer output high/low period
P
OUTHL
1T
—
ns
Figure 25. Timer Timing
Characteristic
Symbol
Min
Max
Unit
Baud Rate
1
1.
2.
3.
4.
f
MAX
is the frequency of operation of the system clock in MHz.
The RXD pin in SCI0 is named RXD0 and the RXD pin in SCI1 is named RXD1.
The TXD pin in SCI0 is named TXD0 and the TXD pin in SCI1 is named TXD1.
Parameters listed are guaranteed by design.
BR
—
(f
MAX
*2.5)/(80)
Mbps
RXD
2
Pulse Width
RXD
PW
0.965/BR
1.04/BR
ns
TXD
3
Pulse Width
TXD
PW
0.965/BR
1.04/BR
ns
Timer Inputs
Timer Outputs
P
OUTHL
P
OUTHL
P
OUT
P
IN
P
INHL
P
INHL
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DSP56F803E | 16-bit Digital Signal Controllers |
| DSP56F805E | 16-bit Digital Signal Controllers |
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| DSP56F805 | 16-bit Hybrid Controller(16位混合控制器) |
| DSP56F807PY80E | 16-bit Digital Signal Controllers |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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