參數資料
型號： DSPIC30F3013-30I/SP
廠商： Microchip Technology
文件頁數： 143/161頁
文件大?。?/td> 0K
描述： IC DSPIC MCU/DSP 24K 28DIP
產品培訓模塊： Serial Communications using dsPIC30F I2C
Serial Communications using dsPIC30F SPI
Serial Communications using dsPIC30F UART
dsPIC30F 12 bit ADC - Part 2
dsPIC30F Addressing Modes - Part 1
dsPIC30F Architecture - Part 1
dsPIC30F DSP Engine & ALU
dsPIC30F Interrupts
dsPIC30F Motor Control PWM
dsPIC Timers
Asynchronous Stimulus
dsPIC30F Addressing Modes - Part 2
dsPIC30F Architecture - Part 2
dsPIC30F 12-bit ADC Part 1
標準包裝： 15
系列： dsPIC™ 30F
核心處理器： dsPIC
芯體尺寸： 16-位
速度： 30 MIP
連通性： I²C，SPI，UART/USART
外圍設備： 欠壓檢測/復位，POR，PWM，WDT
輸入/輸出數： 20
程序存儲器容量： 24KB（8K x 24）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 1K x 8
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 2.5 V ~ 5.5 V
數據轉換器： A/D 10x12b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-DIP（0.300"，7.62mm）
包裝： 管件
產品目錄頁面： 651 (CN2011-ZH PDF)
配用： DV164005-ND - KIT ICD2 SIMPLE SUIT W/USB CABLE
其它名稱： DSPIC30F301330ISP
dsPIC30F2011/2012/3012/3013
DS70139G-page 68
2010 Microchip Technology Inc.
Address Error Trap:
This trap is initiated when any of the following
circumstances occurs:
1.
A misaligned data word access is attempted.
2.
A data fetch from our unimplemented data
memory location is attempted.
3.
A data access of an unimplemented program
memory location is attempted.
4.
An instruction fetch from vector space is
attempted.
5.
Execution of a “BRA #literal” instruction or a
“GOTO #literal” instruction, where literal
is an unimplemented program memory address.
6.
Executing instructions after modifying the PC to
point the unimplemented program memory
addresses. The PC may be modified by loading
a value into the stack and executing a RETURN
instruction.
Stack Error Trap:
This trap is initiated under the following conditions:
The Stack Pointer is loaded with a value which is
greater than the (user programmable) limit value
written into the SPLIM register (stack overflow).
The Stack Pointer is loaded with a value which is
less than 0x0800 (simple stack underflow).
Oscillator Fail Trap:
This trap is initiated if the external oscillator fails and
operation becomes reliant on an internal RC backup.
8.3.2
HARD AND SOFT TRAPS
It is possible that multiple traps can become active
within the same cycle (e.g., a misaligned word stack
write to an overflowed address). In such a case, the
fixed priority shown in Figure 8-2 is implemented,
which may require the user to check if other traps are
pending, in order to completely correct the Fault.
Soft traps include exceptions of priority level 8 through
level 11, inclusive. The arithmetic error trap (level 11)
falls into this category of traps.
Hard traps include exceptions of priority level 12
through level 15, inclusive. The address error (level
12), stack error (level 13) and oscillator error (level 14)
traps fall into this category.
Each hard trap that occurs must be acknowledged
before code execution of any type can continue. If a
lower priority hard trap occurs while a higher priority
trap is pending, acknowledged, or is being processed,
a hard trap conflict occurs.
The device is automatically Reset in a hard trap conflict
condition. The TRAPR Status bit (RCON<15>) is set
when the Reset occurs, so that the condition may be
detected in software.
Note:
In the MAC class of instructions, wherein
the data space is split into X and Y data
space, unimplemented X space includes
all of Y space, and unimplemented Y
space includes all of X space.
相關PDF資料
PDF描述
DSPIC33FJ32MC202-E/SO IC DSPIC MCU/DSP 32K 28SOIC
52745-0896 CONN FFC 8POS .5MM R/A ZIF SMD
52745-0496 CONN FFC 4POS .5MM R/A ZIF SMD
TS87C58X2-LCE IC MCU 8BIT 32K OTP 30MHZ 44VQFP
TS87C54X2-VCE IC MCU 8BIT 16K OTP 40MHZ 44VQFP
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