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參數資料
| 型號： | E5551A-DIT |
| 廠商： | ATMEL CORP |
| 元件分類： | 通信及網絡 |
| 英文描述： | SPECIALTY TELECOM CIRCUIT, UUC7 |
| 封裝： | DIE-7 |
| 文件頁數： | 852/1069頁 |
| 文件大?。?/td> | 14303K |
| 代理商： | E5551A-DIT |
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852
SAM4CP [DATASHEET]
43051E–ATPL–08/14
38.6.2 PWM Channel
38.6.2.1 Block Diagram
Figure 38-3.
Functional View of the Channel Block Diagram
Each of the 4 channels is composed of three blocks:
A clock selector which selects one of the clocks provided by the clock generator described in
Section 38.6.1 “PWM
Clock Generator” on page 851
.
An internal counter clocked by the output of the clock selector. This internal counter is incremented or
decremented according to the channel configuration and comparators events. The size of the internal counter is 16
bits.
A comparator used to generate events according to the internal counter value. It also computes the PWMx output
waveform according to the configuration.
38.6.2.2 Waveform Properties
The different properties of output waveforms are:
the
internal clock selection
. The internal channel counter is clocked by one of the clocks provided by the clock
generator described in the previous section. This channel parameter is defined in the CPRE field of the
PWM_CMRx register. This field is reset at 0.
the
waveform period
. This channel parameter is defined in the CPRD field of the PWM_CPRDx register.
If the waveform is left aligned, then the output waveform period depends on the counter source clock and can be
calculated:
By using the Master Clock (MCK) divided by an X given prescaler value (with X being 1, 2, 4, 8, 16, 32, 64, 128,
256, 512, or 1024), the resulting period formula will be:
MCK
By using a Master Clock divided by one of both DIVA or DIVB divider, the formula becomes, respectively:
or
If the waveform is center aligned then the output waveform period depends on the counter source clock and can
be calculated:
By using the Master Clock (MCK) divided by an X given prescaler value (with X being 1, 2, 4, 8, 16, 32, 64, 128,
256, 512, or 1024). The resulting period formula will be:
By using a Master Clock divided by one of both DIVA or DIVB divider, the formula becomes, respectively:
or
Comparator
PWMx
output waveform
Internal
Counter
Clock
Selector
inputs
from clock
generator
inputs from
APB bus
Channel
*
CPRD
-X
*
CPRD
*
DIVA
MCK
-X
*
CPRD
*
DIVB
MCK
-X
X
*
CPRD
MCK
-2*
X
*
CPRD
*
DIVA
MCK
-2*
X
*
CPRD
*
DIVB
MCK
-2*
相關PDF資料 |
PDF描述 |
|---|---|
| E5551A-S8 | SPECIALTY TELECOM CIRCUIT, PDSO8 |
| EF4442CMG/B(Z63) | SPECIALTY TELECOM CIRCUIT, CDIP28 |
| EF4442CMB/T(Z63) | SPECIALTY TELECOM CIRCUIT, CDIP28 |
| E5550F-DOW | SPECIALTY TELECOM CIRCUIT, UUC7 |
| E5530H-230-S8 | SPECIALTY TELECOM CIRCUIT, PDSO8 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| E5551A-DOW | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Transponder |
| E5551A-FP008 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:TRANSPONDER|CMOS|SOP|8PIN|PLASTIC |
| E5552 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Transponder |
| E555423 | 制造商:Elo Touch Solutions Inc 功能描述:1729L, 17-INCH LCD, CARROLLTOUCH, USB CONTROLLER, GRAY - Bulk |
| E55556-000 | 功能描述:電線鑒定 HTCM-SCE-TP-1/2-4H-4 RoHS:否 制造商:TE Connectivity / Q-Cees 產品:Labels and Signs 類型: 材料:Vinyl 顏色:Blue 寬度:0.625 in 長度:1 in |
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