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參數(shù)資料
| 型號： | EPM7032BLC44-3 |
| 廠商： | Altera |
| 文件頁數(shù)： | 13/66頁 |
| 文件大小： | 0K |
| 描述： | IC MAX 7000 CPLD 32 44-PLCC |
| 標準包裝： | 130 |
| 系列： | MAX® 7000B |
| 可編程類型： | 系統(tǒng)內(nèi)可編程 |
| 最大延遲時間 tpd(1)： | 3.5ns |
| 電壓電源 - 內(nèi)部： | 2.375 V ~ 2.625 V |
| 邏輯元件/邏輯塊數(shù)目： | 2 |
| 宏單元數(shù)： | 32 |
| 門數(shù)： | 600 |
| 輸入/輸出數(shù)： | 36 |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 44-LCC（J 形引線） |
| 供應(yīng)商設(shè)備封裝： | 44-PLCC（16.58x16.58） |
| 包裝： | 管件 |
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20
Altera Corporation
MAX 7000B Programmable Logic Device Data Sheet
The instruction register length of MAX 7000B devices is ten bits. The
boundary-scan register length and device IDCODE information for
MAX 7000B devices.
Notes:
(1)
The most significant bit (MSB) is on the left.
(2)
The least significant bit (LSB) for all JTAG IDCODEs is 1.
f SeeApplicationNote39(IEEE1149.1(JTAG)Boundary-ScanTestinginAltera
Devices) for more information on JTAG boundary-scan testing.
Figure 8 shows the timing information for the JTAG signals.
Table 7. MAX 7000B Boundary-Scan Register Length
Device
Boundary-Scan Register Length
EPM7032B
96
EPM7064B
192
EPM7128B
288
EPM7256B
480
EPM7512B
624
Table 8. 32-Bit MAX 7000B Device IDCODE
Device
IDCODE (32 Bits)
Version
(4 Bits)
Part Number (16 Bits)
Manufacturer’s
Identity (11 Bits)
1 (1 Bit)
EPM7032B
0010
0111 0000 0011 0010
00001101110
1
EPM7064B
0010
0111 0000 0110 0100
00001101110
1
EPM7128B
0010
0111 0001 0010 1000
00001101110
1
EPM7256B
0010
0111 0010 0101 0110
00001101110
1
EPM7512B
0010
0111 0101 0001 0010
00001101110
1
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