參數(shù)資料
型號： EPM7032BLC44-3
廠商： Altera
文件頁數(shù)： 31/66頁
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描述： IC MAX 7000 CPLD 32 44-PLCC
標準包裝： 130
系列： MAX® 7000B
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1)： 3.5ns
電壓電源 - 內(nèi)部： 2.375 V ~ 2.625 V
邏輯元件/邏輯塊數(shù)目： 2
宏單元數(shù)： 32
門數(shù)： 600
輸入/輸出數(shù)： 36
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 44-LCC（J 形引線）
供應(yīng)商設(shè)備封裝： 44-PLCC（16.58x16.58）
包裝： 管件
Altera Corporation
37
MAX 7000B Programmable Logic Device Data Sheet
Table 20. EPM7032B Selectable I/O Standard Timing Adder Delays
I/O Standard
Parameter
Speed Grade
Unit
-3.5
-5.0
-7.5
Min
Max
Min
Max
Min
Max
3.3 V TTL/CMOS
Input to (PIA)
0.0
ns
Input to global clock and clear
0.0
ns
Input to fast input register
0.0
ns
All outputs
0.0
ns
2.5 V TTL/CMOS
Input to PIA
0.3
0.4
0.6
ns
Input to global clock and clear
0.3
0.4
0.6
ns
Input to fast input register
0.2
0.3
0.4
ns
All outputs
0.2
0.3
0.4
ns
1.8 V TTL/CMOS
Input to PIA
0.5
0.8
1.1
ns
Input to global clock and clear
0.5
0.8
1.1
ns
Input to fast input register
0.4
0.5
0.8
ns
All outputs
1.2
1.8
2.6
ns
SSTL-2 Class I
Input to PIA
1.3
1.9
2.8
ns
Input to global clock and clear
1.2
1.8
2.6
ns
Input to fast input register
0.9
1.3
1.9
ns
All outputs
0.0
ns
SSTL-2 Class II
Input to PIA
1.3
1.9
2.8
ns
Input to global clock and clear
1.2
1.8
2.6
ns
Input to fast input register
0.9
1.3
1.9
ns
All outputs
–0.1
–0.2
ns
SSTL-3 Class I
Input to PIA
1.2
1.8
2.6
ns
Input to global clock and clear
0.9
1.3
1.9
ns
Input to fast input register
0.8
1.1
1.7
ns
All outputs
0.0
ns
SSTL-3 Class II
Input to PIA
1.2
1.8
2.6
ns
Input to global clock and clear
0.9
1.3
1.9
ns
Input to fast input register
0.8
1.1
1.7
ns
All outputs
0.0
ns
GTL+
Input to PIA
1.6
2.3
3.4
ns
Input to global clock and clear
1.6
2.3
3.4
ns
Input to fast input register
1.5
2.1
3.2
ns
All outputs
0.0
ns
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PDF描述
PQ015ENA1ZZH IC REG LDO 1.5V 1A SC-63
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180-M26-203L021 CONN DB26 FMAL HD SLD CUP NICKEL
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