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參數(shù)資料
| 型號： | EPM7032BLC44-3 |
| 廠商： | Altera |
| 文件頁數(shù)： | 41/66頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAX 7000 CPLD 32 44-PLCC |
| 標(biāo)準(zhǔn)包裝： | 130 |
| 系列： | MAX® 7000B |
| 可編程類型： | 系統(tǒng)內(nèi)可編程 |
| 最大延遲時間 tpd(1)： | 3.5ns |
| 電壓電源 - 內(nèi)部： | 2.375 V ~ 2.625 V |
| 邏輯元件/邏輯塊數(shù)目： | 2 |
| 宏單元數(shù)： | 32 |
| 門數(shù)： | 600 |
| 輸入/輸出數(shù)： | 36 |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 44-LCC（J 形引線） |
| 供應(yīng)商設(shè)備封裝： | 44-PLCC（16.58x16.58） |
| 包裝： | 管件 |
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46
Altera Corporation
MAX 7000B Programmable Logic Device Data Sheet
Notes to tables:
(1)
These values are specified under the Recommended Operating Conditions in Table 15 on page 29. See Figure 14 for
more information on switching waveforms.
(2)
These values are specified for a PIA fan-out of one LAB (16 macrocells). For each additional LAB fan-out in these
devices, add an additional 0.1 ns to the PIA timing value.
(3)
Measured with a 16-bit loadable, enabled, up/down counter programmed into each LAB.
(4)
The tLPA parameter must be added to the tLAD, tLAC, tIC, tACL, tCPPW, tEN, and tSEXP parameters for macrocells
running in low-power mode.
PCI
Input to PIA
0.0
ns
Input to global clock and clear
0.0
ns
Input to fast input register
0.0
ns
All outputs
0.0
ns
Table 26. EPM7128B Selectable I/O Standard Timing Adder Delays (Part 2 of 2)
Note (1)
I/O Standard
Parameter
Speed Grade
Unit
-4
-7
-10
Min
Max
Min
Max
Min
Max
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PQ015ENA1ZZH | IC REG LDO 1.5V 1A SC-63 |
| VI-2TZ-CY-F3 | CONVERTER MOD DC/DC 2V 20W |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| EPM7032BLC44-5 | 制造商:Rochester Electronics LLC 功能描述: 制造商:Altera Corporation 功能描述: |
| EPM7032BLC44-7 | 制造商:Rochester Electronics LLC 功能描述: 制造商:Altera Corporation 功能描述: |
| EPM7032BTC44-3 | 制造商:Altera Corporation 功能描述:IC MAX |
| EPM7032BTC44-3N | 制造商:Altera Corporation 功能描述:IC MAX |
| EPM7032BTC44-5 | 制造商:Altera Corporation 功能描述:CPLD MAX 7000B Family 600 Gates 32 Macro Cells 212.8MHz CMOS Technology 2.5V 44-Pin TQFP |
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