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參數(shù)資料
| 型號(hào)： | FW323 |
| 英文描述： | 1394A PCI PHY/Link Open Host Controller Interface |
| 中文描述： | 1394A端口物理層的PCI /鏈接開(kāi)放主機(jī)控制器接口 |
| 文件頁(yè)數(shù)： | 24/152頁(yè) |
| 文件大?。?/td> | 1625K |
| 代理商： | FW323 |
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24
Agere Systems Inc.
FW323 05
1394A PCI PHY/Link Open Host Controller Interface
Data Sheet, Rev. 2
October 2001
Internal Registers
(continued)
Table 7. PCI Command Register Description
Bit
15:10
9
Field Name
Reserved
FBB_ENB
Type
R
R
Description
Reserved.
Bits 15:10 return 0s when read.
Fast Back-to-Back Enable.
The FW323 does not generate fast back-
to-back transactions; thus, this bit returns 0 when read.
SERR Enable.
When this bit is set, the FW323 SERR driver is enabled.
SERR can be asserted after detecting an address parity error on the PCI
bus.
Address/Data Stepping Control.
The FW323 does not support
address/data stepping; thus, this bit is hardwired to 0.
Parity Error Enable.
When this bit is set, the FW323 is enabled to drive
PERR response to parity errors through the PERR signal.
VGA Palette Snoop Enable.
The FW323 does not feature VGA palette
snooping. This bit returns 0 when read.
Memory Write and Invalidate Enable.
When this bit is set, the FW323
is enabled to generate MWI PCI bus commands. If this bit is reset, then
the FW323 generates memory write commands instead.
Special Cycle Enable.
The FW323 function does not respond to special
cycle transactions. This bit returns 0 when read.
Bus Master Enable.
When this bit is set, the FW323 is enabled to
initiate cycles on the PCI bus.
Memory Response Enable.
Setting this bit enables the FW323 to
respond to memory cycles on the PCI bus. This bit must be set to access
OHCI registers.
I/O Space Enable.
The FW323 does not implement any I/O mapped
functionality; thus, this bit returns 0 when read.
8
SERR_ENB
RW
7
STEP_ENB
R
6
PERR_ENB
RW
5
VGA_ENB
R
4
MWI_ENB
RW
3
SPECIAL
R
2
MASTER_ENB
RW
1
MEMORY_ENB
RW
0
IO_ENB
R
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| FW32305 | 1394A PCI PHY/Link Open Host Controller Interface |
| FW352 | |
| FW501 | TRANSISTOR | MOSFET | N-CHANNEL | 30V V(BR)DSS | 7A I(D) | SO |
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| FW801A-DB | Low-Power PHY IEEE 1394A-2000 One-Cable Transceiver/Arbiter Device |
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