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參數(shù)資料
| 型號： | GPTRM |
| 英文描述： | General-Purpose Timer Reference Manual |
| 中文描述： | 通用定時器參考手冊 |
| 文件頁數(shù)： | 53/90頁 |
| 文件大?。?/td> | 647K |
| 代理商： | GPTRM |
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GPT
REFERENCE MANUAL
GENERAL-PURPOSE I/O
MOTOROLA
8-1
SECTION 8GENERAL-PURPOSE I/O
Any GPT pin, if not used for a GPT function, can be used as general-purpose I/O.
Some pins are bidirectional, others are output only or input only. The bidirectional pins
are associated with the compare/capture functions.
8.1 General-Purpose I/O
Pins associated with input capture and output compare functions can be used either
for timing functions or as general-purpose I/O pins. All are bidirectional when used for
general-purpose I/O; together they are treated as an 8-bit parallel data port. The direc-
tion of each pin is controlled by the corresponding data direction bit in the parallel data
direction register (PDDR). Refer to
Figure 8-1
.
When the bits in the PDDR are set to zero, the corresponding bits in the PDR are con-
figured as inputs. A one configures the bits as outputs.
Parallel data is read from and written to the parallel data register (PDR) (Figure 8-1).
Pin data can be read from the PDR, even when the pins are configured for an alternate
timer function. Data read from the parallel data register always reflects the state of the
external pin; whereas, data written to the parallel data register may not always affect
the external pin.
Data written to the PDR does not directly affect pins used by the output compare func-
tions, but the data is latched so that if the output compare function is later disabled,
the last data written to the PDR is driven out on the associated output pin (if the pin is
configured as an output pin). Data written to the PDR can cause input captures if the
corresponding pin is configured as an input capture function.
Figure 8-1 Parallel Data Direction/Parallel Data Registers (PDDR/PDR)
DDRx [15:8] — Data Direction for Input Capture/Output Compare Pins
0 = Input only
1 = Output
Bits [7:0] — Parallel Data Port
These bits represent input or output data at the pins depending on the state of the cor-
responding bit in the PDDR register.
For details on the operation of the input capture and output compare functions refer to
SECTION 3 COMPARE/CAPTURE UNIT
.
PDDR/PDR —
Parallel Data Direction Register/Parallel Data Register
$YFF906
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
DDRI4O5 DDRO4 DDRO3 DDRO2 DDRO1
DDRI3
DDRI2
DDRI1
IC4/OC5
OC4
OC3
OC2
OC1
IC3
IC2
IC1
RESET:
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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