參數(shù)資料
型號(hào): HM5425801B
廠商: Hitachi,Ltd.
英文描述: 256M SSTL_2 interface DDR SDRAM(256M SSTL_2接口 DDR 同步DRAM)
中文描述: 256M DDR SDRAM的接口SSTL_2(256M SSTL_2接口的DDR同步DRAM)的
文件頁數(shù): 40/62頁
文件大?。?/td> 1016K
代理商: HM5425801B
HM5425161B, HM5425801B, HM5425401B Series
40
Bank active command interval:
Destination row of the
consecutive ACTV command
Bank
address
Row
address
State
Operation
1. Same
Any
ACTIVE
Two successive ACTV commands can be issued at t
interval. In
between two successive ACTV operations, precharge command
should be executed.
2. Different
Any
ACTIVE
Prechage the bank. t
after the precharge command, the consecutive
ACTV command can be issued.
IDLE
t
RRD
after an ACTV command, the next ACTV command can be issued.
Bank Active to Bank Active
CLK
CLK
Command
BA
t
RC
Address
ACTV
t
RRD
Bank0
Active
Bank3
Active
Bank0
Precharge
Bank0
Active
!
"
#
PRE
ACTV
ROW: 0
NOP
NOP
NOP
ACTV
ROW: 1
ROW: 0
Mode register set to Bank-active command interval:
The interval between setting the mode register and
executing a bank-active command must be no less than t
MRD
.
CLK
CLK
Command
Address
NOP
NOP
MRS
ACTV
t
MRD
Mode Register Set
Bank3
Active
"
CODE
BS and ROW
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PDF描述
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