參數(shù)資料
型號: HM5425801B
廠商: Hitachi,Ltd.
英文描述: 256M SSTL_2 interface DDR SDRAM(256M SSTL_2接口 DDR 同步DRAM)
中文描述: 256M DDR SDRAM的接口SSTL_2(256M SSTL_2接口的DDR同步DRAM)的
文件頁數(shù): 9/62頁
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代理商: HM5425801B
HM5425161B, HM5425801B, HM5425401B Series
9
Block Diagram
Column address
counter
Column address
buffer
Row address
buffer
Bank
select
Refresh
counter
Address register
Address (A0 to A14)
AY0 to AY11
AX0 to AX12
AX13, AX14
A0 to A14
DQ*
2
Input
buffer
Output
buffer
DQS
buffer
Row
decoder
S
C
Bank 0
*
1
*
1
*
1
*
1
Notes: 1. 8192 row
×
512 column
×
16 bit: HM5425161B
8192 row
×
1024 column
×
8 bit: HM5425801B
8192 row
×
2048 column
×
4 bit: HM5425401B
2. DQ0 to DQ15: HM5425161B
DQ0 to DQ7: HM5425801B
DQ0 to DQ3: HM5425401B
Row
decoder
S
C
Bank 1
Row
decoder
S
C
Bank 2
Row
decoder
CLK
CKE
DM,
DMU/DML
DLL
DQS,
DQSU/DQSL
CLK
RAS
CAS
WE
CS
S
C
Bank 3
C
Mode register
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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