參數(shù)資料
型號: HM5425801B
廠商: Hitachi,Ltd.
英文描述: 256M SSTL_2 interface DDR SDRAM(256M SSTL_2接口 DDR 同步DRAM)
中文描述: 256M DDR SDRAM的接口SSTL_2(256M SSTL_2接口的DDR同步DRAM)的
文件頁數(shù): 41/62頁
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代理商: HM5425801B
HM5425161B, HM5425801B, HM5425401B Series
41
DMU/DML Control
(HM5425161B)
DMU can mask upper byte of input data. DML can mask lower byte of input data. By setting DMU/DML to
Low, data can be written. When DMU/DML is set to High, the corresponding data is not written, and the
previous data is held. The latency between DMU/DML input and enabling/disabling mask function is 0.
DM Control
(HM5425801B/HM5425401B)
DM can mask input data. By setting DM to Low, data can be written. When DM is set to High, the
corresponding data is not written, and the previous data is held. The latency between DM input and
enabling/disabling mask function is 0.
Mask
Mask
DQS,
DQSU/DQSL
DQ
DM,
DMU/DML
t1
t2
t3
t4
t5
t6
Write mask latency = 0
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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HM5425801BTT-75B 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:256M SSTL_2 interface DDR SDRAM 143 MHz/133 MHz/125 MHz/100 MHz 4-Mword 】 16-bit 】 4-bank/8-Mword 】 8-bit 】 4-bank/ 16-Mword 】 4-bit 】 4-bank
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