參數(shù)資料
型號： ICS1892Y-14
英文描述： 10Base-T/100Base-TX Integrated PHYceiver
文件頁數(shù)： 127/148頁
文件大?。?/td> 816K
代理商： ICS1892Y-14
Chapter 10
DC and AC Operating Conditions
ICS1892, Rev. D, 2/26/01
February 26, 2001
127
ICS1892
2000-2001, Integrated Circuit Systems, Inc.
All rights reserved.
10.5.4
100M MII / 100M Stream Interface: Synchronous Transmit Timing
Table 10-11
lists the significant time periods for the 100M MII / 100M Stream Interface synchronous
transmit timing (which consists of timings of signals on the TXD[3:0], TXEN, TXER, and TXCLK pins).
Figure 10-4
shows the timing diagram for the time periods.
Figure 10-4.
100M MII / 100M Stream Interface Synchronous Transmit Timing Diagram
Table 10-11.
100M MII / 100M Stream Interface: Synchronous Transmit Timing
Time
Period
Parameter
Conditions
Min.
Typ.
Max.
Units
t1
TXD[3:0], TXEN, TXER Setup to TXCLK Rise
–
15
–
–
ns
t2
TXD[3:0], TXEN, TXER Hold after TXCLK Rise
–
0
–
–
ns
TXCLK
TXD[3:0]
TXEN
TXER
t1
t2
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