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參數(shù)資料
| 型號： | IDT82P2916BFG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 129/138頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC LIU T1/E1/J1 16CH SH 484BGA |
| 標準包裝： | 84 |
| 功能： | 線路接口單元（LIU） |
| 接口： | E1，J1，T1 |
| 電路數(shù)： | 16 |
| 電源電壓： | 1.8V, 3.3V |
| 功率（瓦特）： | 3.10W |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 484-LFBGA |
| 供應商設備封裝： | 484-CABGA（19x19） |
| 包裝： | 托盤 |
| 包括： | AIS 警報檢測器和發(fā)生器，回送功能，PRBS 發(fā)生器 / 檢測器，遠程檢測器和發(fā)生器 |
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IDT82P2916
16-CHANNEL HIGH-DENSITY T1/E1/J1 LINE INTERFACE UNIT
Programming Information
90
April 24, 2010
ERR - Error Detection & Insertion Control Register
1 - 0
TDLOS[1:0]
These bits select the period. When the amplitude of the data is less than a certain voltage for the period, TLOS is declared. The
voltage is determined by the TALOS bits (b3~2, LOS,...).
00: 16-pulse.
01: 32-pulse. (default)
1X: 64-pulse.
Address: 00EH, 04EH, 08EH, 0CEH, 10EH, 14EH, 18EH, 1CEH, (CH1~CH8)
20EH, 24EH, 28EH, 2CEH, 30EH, 34EH, 38EH, (CH9~CH15)
7CEH (CH0)
Type: Read / Write
Default Value: 00H
Bit
Name
Description
7
EXZ_DEF
This bit selects the EXZ definition standard.
0: ANSI. (default)
1: FCC.
6
BPV_INS
This bit controls whether to insert a bipolar violation (BPV) to the transmit path.
Writing ‘1’ to this bit will insert a BPV on the next available mark in the data stream to be transmitted.
This bit is cleared once the BPV insertion is completed.
5
ERR_INS
This bit controls whether to insert a single bit error to the generated PRBS/ARB pattern.
A transition from ‘0’ to ‘1’ on this bit will insert a single bit error to the generated PRBS/ARB pattern.
This bit is cleared once the single bit error insertion is completed.
4 - 2
CNT_SEL[2:0] These bits select what kind of error to be counted by the internal Error Counter.
000: Disable. (default)
001: LBPV.
010: LEXZ.
011: LBPV + LEXZ.
100: SBPV.
101: SEXZ.
110: SBPV + SEXZ.
111: PRBS/ARB error.
1
CNT_MD
This bit determines whether the ERRCH & ERRCL registers are updated automatically or manually.
0: Manually by setting the CNT_STOP bit (b0, ERR,...). (default)
1: Every-one second automatically.
0
CNT_STOP
This bit is valid only when the CNT_MD bit (b1, ERR,...) is ‘0’.
A transition from ‘0’ to ‘1’ on this bit updates the ERRCH & ERRCL registers.
This bit must be cleared before the next round.
7
654321
0
EXZ_DEF
BPV_INS
ERR_INS
CNT_SEL2
CNT_SEL1
CNT_SEL0
CNT_MD
CNT_STOP
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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