參數(shù)資料
型號: IDT82V2108BB
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 24/292頁
文件大?。?/td> 0K
描述: IC FRAMER T1/J1/E1 8CH 144-BGA
標(biāo)準(zhǔn)包裝: 10
控制器類型: T1/E1/J1 調(diào)幀器
接口: 并聯(lián)
電源電壓: 2.97 V ~ 3.63 V
電流 - 電源: 160mA
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 144-BGA
供應(yīng)商設(shè)備封裝: 144-PBGA(13x13)
包裝: 托盤
其它名稱: 82V2108BB
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IDT82V2108
T1 / E1 / J1 OCTAL FRAMER
Description
2
March 5, 2009
DESCRIPTION
The IDT82V2108 is a flexible feature-rich octal T1/E1/J1 Framer.
Controlled by software, the IDT82V2108 can be globally configured as
an Octal E1 or T1/J1 Framer. When E1 or T1/J1 has been set globally,
the operation mode of each of the eight framers can be configured inde-
pendently. The configuration is performed through a parallel Multiplexed/
Non-Multiplexed microprocessor interface.
The IDT82V2108 realizes frame synchronization, frame generation,
signaling extraction and insertion, alarm and test signals generation and
detection in a single chip. It also integrates up to three HDLC receivers
and HDLC transmitters for each of the eight framers.
In E1 Mode, the receive path of each framer can be configured to
be Basic Frame, CRC Multi-Frame and Signaling Multi-Frame. The
framing can also be bypassed (unframed mode). It detects and indicates
the event of out of Basic Frame Synchronization, out of CRC Multi-
Frame and out of Signaling Multi-Frame. It also detects and indicates
the Remote Alarm Indication signal and the Remote Signaling Multi-
Frame Alarm Indication signal. The Red and AIS alarms are monitored.
Basic Frame Alignment Signal errors, Far End Block Errors (FEBE) and
CRC errors are counted. Up to three HDLC links are provided to extract
the HDLC message on TS16, the Sa National bits and/or any arbitrary
time slot. An Elastic Store Buffer that optionally supports slip buffering
and adaptation to backplane timing is provided. In E1 receive path, sig-
naling debounce, signaling freezing, idle code substitution, digital milli-
watt code insertion, trunk conditioning, data inversion and pattern
generation or detection are also supported on a per-timeslot basis.
In E1 mode, the transmit path of each framer can be configured to
generate Basic Frame, CRC Multi-Frame and Signaling Multi-Frame.
The framing can also be disabled (unframed mode). It can also transmit
Remote Alarm Indication signal, Remote Signaling Multi-Frame Alarm
Indication signal, AIS signal and FEBE. Up to three HDLC links are pro-
vided to insert the HDLC message on TS16, the Sa National bits and/or
any arbitrary time slot. The signaling insertion, idle code substitution,
data insertion, data inversion and test pattern generation or detection
are also supported on a per-timeslot basis.
In E1 mode, any four of the eight framers can be multiplexed or de-
multiplexed to or from one of the two 8.192M bit/s buses.
In T1/J1 mode, the receive path of each framer can be configured
to be in Super Frame (SF) or Extended Super Frame (ESF) formats.
The framing can also be bypassed (unframed mode). It detects and indi-
cates the out of SF/ESF synchronization event, the Yellow, Red and AIS
alarms. It also detects the presence of inband loopback codes, bit ori-
ented message. Frame Alignment Signal errors, CRC-6 errors, out of
SF/ESF events and Frame Alignment position changes are counted. Up
to two HDLC links are provides to extract the HDLC message on the F-
bit or any arbitrary channels in ESF format. An Elastic Store Buffer that
optionally supports controlled slip and adaptation to backplane timing is
provided. In T1/J1 receive path, signaling debounce, signaling freezing,
idle code substitution, digital milliwatt code insertion, idle code insertion,
data inversion and pattern generation or detection are also supported on
a per-channel basis.
In T1/J1 mode, the transmit path of each framer can be configured
to generate SF or ESF. The framing can also be disabled (unframed
mode). It can also transmit Yellow signal and AIS signal. Inband loop-
back codes and bit oriented message can also be transmitted. Up to two
HDLC links are provided to insert the HDLC message on the F-bit or any
arbitrary channels in ESF format. The signaling insertion, idle code sub-
stitution, data insertion, data inversion and test pattern generation or
detection are also supported on a per-channel basis.
In T1/J1 mode, the data stream of 1.544M bit/s can be converted
to/from the data stream of 2.048M bit/s on the system side by software
configuration. In addition, any four of the eight framers can be multi-
plexed or de-multiplexed to or from one of the two 8.192M bit/s buses.
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PDF描述
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參數(shù)描述
IDT82V2108BBG 功能描述:IC FRAMER T1/J1/E1 8CH 144-BGA RoHS:是 類別:集成電路 (IC) >> 接口 - 控制器 系列:- 標(biāo)準(zhǔn)包裝:4,900 系列:- 控制器類型:USB 2.0 控制器 接口:串行 電源電壓:3 V ~ 3.6 V 電流 - 電源:135mA 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:36-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:36-QFN(6x6) 包裝:* 其它名稱:Q6396337A
IDT82V2108PX 功能描述:IC FRAMER T1/J1/E1 8CH 128-PQFP RoHS:否 類別:集成電路 (IC) >> 接口 - 控制器 系列:- 標(biāo)準(zhǔn)包裝:4,900 系列:- 控制器類型:USB 2.0 控制器 接口:串行 電源電壓:3 V ~ 3.6 V 電流 - 電源:135mA 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:36-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:36-QFN(6x6) 包裝:* 其它名稱:Q6396337A
IDT82V2108PX8 功能描述:IC FRAMER T1/J1/E1 8CH 128-PQFP RoHS:否 類別:集成電路 (IC) >> 接口 - 控制器 系列:- 標(biāo)準(zhǔn)包裝:4,900 系列:- 控制器類型:USB 2.0 控制器 接口:串行 電源電壓:3 V ~ 3.6 V 電流 - 電源:135mA 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:36-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:36-QFN(6x6) 包裝:* 其它名稱:Q6396337A
IDT82V2108PXG 功能描述:IC FRAMER T1/J1/E1 8CH 128-PQFP RoHS:是 類別:集成電路 (IC) >> 接口 - 控制器 系列:- 標(biāo)準(zhǔn)包裝:4,900 系列:- 控制器類型:USB 2.0 控制器 接口:串行 電源電壓:3 V ~ 3.6 V 電流 - 電源:135mA 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:36-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:36-QFN(6x6) 包裝:* 其它名稱:Q6396337A
IDT82V2108PXG8 功能描述:IC FRAMER T1/J1/E1 8CH 128-PQFP RoHS:是 類別:集成電路 (IC) >> 接口 - 控制器 系列:- 標(biāo)準(zhǔn)包裝:4,900 系列:- 控制器類型:USB 2.0 控制器 接口:串行 電源電壓:3 V ~ 3.6 V 電流 - 電源:135mA 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:36-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:36-QFN(6x6) 包裝:* 其它名稱:Q6396337A