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參數(shù)資料
| 型號： | ISP1561BM |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | ISP1561BM |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP128 |
| 封裝： | 14 X 14 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-420-1, LQFP-128 |
| 文件頁數(shù)： | 20/102頁 |
| 文件大?。?/td> | 2875K |
| 代理商： | ISP1561BM |
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Philips Semiconductors
ISP1561
USB PCI host controller
Product data
Rev. 01 — 06 February 2003
20 of 102
9397 750 10015
Koninklijke Philips Electronics N.V. 2003. All rights reserved.
Revision ID register (address: 08H):
This one-byte read-only register indicates a
device specific revision identifier. The value is chosen by the vendor. This field is a
vendor defined extension of the Device ID. The Revision ID register bit description is
given in
Table 10
.
Class Code register (address: 09H):
Class Code is a 24-bit read-only register used
to identify the generic function of the device, and in some cases, a specific
register-level programming interface.
Table 11
shows the bit allocation of the register.
The Class Code register is divided into three byte-size fields. The upper byte is a
base class code that broadly classifies the type of function the device performs. The
middle byte is a sub-class code that identifies more specifically the function of the
device. The lower byte identifies a specific register-level programming interface, if
any, so that device independent software can interact with the device.
[1]
X is 1H for OHCI1 and OHCI2; X is 2H for EHCI.
5
66MC
66 MHz Capable
: This read-only bit indicates whether or not this
device is capable of running at 66 MHz. A value of logic 0
indicates 33 MHz, and a value of logic 1 indicates 66 MHz.
Capabilities List
: This read-only bit indicates whether or not
this device implements the pointer for a New Capabilities linked
list at offset 34H. A value of logic 0 indicates that no New
Capabilities linked list is available. A value of logic 1 indicates
that the value read at offset 34H is a pointer in Configuration
Space to a linked list of new capabilities.
reserved
4
CL
3 to 0
-
Table 9:
Bit
Status register: bit description
…continued
Symbol
Description
Table 10:
Bit
7 to 0
Revision ID register: bit description
Symbol
Access
REVID[7:0]
R
Value
30H
Description
Revision ID
: This byte specifies the design revision number of
functions.
Table 11:
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
Class Code register: bit allocation
23
22
21
20
19
18
17
16
BCC[7:0]
0CH
R
15
14
13
12
11
10
9
8
SCC[7:0]
03H
R
7
6
5
4
3
2
1
0
RLPI[7:0]
X0H
[1]
R
相關PDF資料 |
PDF描述 |
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