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參數(shù)資料
| 型號(hào)： | ISP1561BM |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | ISP1561BM |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP128 |
| 封裝： | 14 X 14 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-420-1, LQFP-128 |
| 文件頁數(shù)： | 58/102頁 |
| 文件大小： | 2875K |
| 代理商： | ISP1561BM |
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Philips Semiconductors
ISP1561
USB PCI host controller
Product data
Rev. 01 — 06 February 2003
58 of 102
9397 750 10015
Koninklijke Philips Electronics N.V. 2003. All rights reserved.
11.1.20
HcRhDescriptorB register (address: value read from func0 or func1 of address
10H
+
4CH)
The HcRhDescriptorB register is the second of two registers describing the
characteristics of the Root Hub. The bit allocation is given in
Table 80
. These fields
are written during initialization to correspond with the system implementation. Reset
values are implementation-specific.
9
NPS
NoPowerSwitching
: This bit is used to specify whether power
switching is supported or ports are always powered. It is
implementation-specific. When this bit is cleared, the PSM
(PowerSwitchingMode) field specifies global or per-port
switching.
0 —
ports are power switched
1 —
ports are always powered on when the Host Controller is
powered on
PowerSwitchingMode:
This bit is used to specify how the
power switching of Root Hub ports is controlled. It is
implementation-specific. This field is only valid if the NPS field
is cleared.
8
PSM
0 —
all ports are powered at the same time.
1 —
each port is powered individually. This mode allows port
power to be controlled by either the global switch or per-port
switching. If the PPCM (PortPowerControlMask) bit is set, the
port responds only to port power commands
(Set/ClearPortPower). If the port mask is cleared, then the port
is controlled only by the global power switch
(Set/ClearGlobalPower).
NumberDownstreamPorts:
These bits specify the number of
downstream ports supported by the Root Hub. It is
implementation-specific. The minimum number of ports is 1.
The maximum number of ports supported by OHCI is 15.
7 to 0
NDP[7:0]
Table 79:
Bit
HcRhDescriptorA register: bit description
…continued
Symbol
Description
Table 80:
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
HcRhDescriptorB register: bit allocation
31
30
29
28
27
26
25
24
PPCM[15:0]
0
0
0
0
0
R
19
0
0
0
R/W
23
R/W
22
R/W
21
R/W
20
R/W
18
R/W
17
R/W
16
PPCM[7:0]
0
0
0
0
0
0
0
0
R/W
15
R/W
14
R/W
13
R/W
12
R/W
11
R/W
10
R/W
9
R/W
8
DR[15:8]
0
0
0
0
0
0
0
0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
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