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參數(shù)資料
| 型號： | LP1072 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | 802.11a/b/g Baseband System Solution |
| 中文描述： | 802.11a/b/g無線基帶系統(tǒng)解決方案 |
| 文件頁數(shù)： | 18/32頁 |
| 文件大?。?/td> | 293K |
| 代理商： | LP1072 |
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LP1072 Advance Information, Rev. 0.3
18
Freescale Semiconductor
PRELIMINARY
Pinout and Footprint
AVDD_PLL
pdiana2p
N/A
Analog 1.8 volt
C1
AVSS_PLL
pdiana2p
N/A
Analog ground
D1
TAVDDPOWER
pvdd3p
N/A
3.3 volt power for ESD Diodes
E3
DVDD_PLL
pdiana2p
N/A
1.8 volt digital power for PLL
E1
DVSS_PLL
pdiana2p
N/A
1.8 volt digital ground for PLL
E2
TXCO_BYPASS
pdidgz
Input
Bypass the TCXO and use the TCXO_BYPASS_CLK
C11
TXCO_BYPASS_CLK
pdidgz
Input
TCXO bypass clock
D11
XTAL_BYPASS
pdidgz
Input
Bypass XTAL osc and use XTAL_BYPASS_CLK
D15
XTAL_BYPASS_CLK
pdidgz
Input
XTAL bypass clock
D13
FAST_CLK_POWER
pdo02cdg
Output
Enable the TCXO
C10
XTAL_32K_XIN
pdxoe4dg
Analog
32kHz crystal (NOTE: Must be placed next to PVDD1DGZ.)
C15
XTAL_32K_XOUT
Analog
32kHz crystal
C14
RESET_N
pdisdgz
Input
Chip Reset
E13
CHIP_MODE0
pdidgz
Input
Chip Mode Select
0000 = SDIO normal operation
0001 = CF+ normal operation
All other modes are reserved
G2
CHIP_MODE1
pdidgz
Input
J1
CHIP_MODE2
pdidgz
Input
H3
CHIP_MODE3
pdidgz
Input
K1
JTAG
JTAG_RESET
pdudgz
Input
Tap reset
P8
JTAG_CLOCK
pdisdgz
Input
Tap clock
M8
JTAG_DI
pdudgz
Input
Tap data in
R10
JTAG_DO
pdo02cdg
Output
Tap data out
N10
JTAG_MODE
pdudgz
Input
Tap Mode
R11
ARM Sub-system Signals
ARM_GPIO0
pdb04dgz
Bi-dir
General Purpose I/O
R1
ARM_GPIO1
pdb04dgz
Bi-dir
General Purpose I/O
N3
ARM_GPIO2
pdb04dgz
Bi-dir
General Purpose I/O
R3
ARM_GPIO3
pdb04dgz
Bi-dir
General Purpose I/O
N4
ARM_GPIO4
pdb04dgz
Bi-dir
General Purpose I/O
P4
ARM_GPIO5
pdb04dgz
Bi-dir
General Purpose I/O
N5
ARM_GPIO6
pdb04dgz
Bi-dir
General Purpose I/O
P5
ARM_GPIO7
pdb04dgz
Bi-dir
General Purpose I/O
R5
ARM_UART_0_DI
pdb04dgz
Input
UART input data
N7
ARM_UART_0_DO
pdb04dgz
Output
UART output data
P6
ARM_EEPROM_DAT_GPIO
pdb04dgz
Bi-dir
General Purpose I/O dedicated for EEPROM
M7
Table 9. Pin Description (continued)
Pad Name
Pad Type
Direction
Description
Pin
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| LPR30 | LOW DROP VOLTAGE REGULATOR DRIVE FOR EXTERNAL N-CHANNEL POWER MOSFET |
| LPR30D | LOW DROP VOLTAGE REGULATOR DRIVE FOR EXTERNAL N-CHANNEL POWER MOSFET |
| LPR30D-TR | LOW DROP VOLTAGE REGULATOR DRIVE FOR EXTERNAL N-CHANNEL POWER MOSFET |
| LPR30N | LOW DROP VOLTAGE REGULATOR DRIVE FOR EXTERNAL N-CHANNEL POWER MOSFET |
| LRI512 | Memory TAG IC 512 bit High Endurance EEPROM 13.56MHz, ISO 15693 Standard Compliant with E.A.S. |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| LP108 | 功能描述:開關(guān)配件 UNDERLOAD RoHS:否 制造商:C&K Components 類型:Cap 用于:Pushbutton Switches 設(shè)計目的: |
| LP1083 | 制造商:FCI 制造商全稱:First Components International 功能描述:LOW DROPOUT POSITVITE ADJUSTABLE REGULATOR |
| LP1083CM | 制造商:FCI 制造商全稱:First Components International 功能描述:LOW DROPOUT POSITVITE ADJUSTABLE REGULATOR |
| LP1083CZ | 制造商:FCI 制造商全稱:First Components International 功能描述:LOW DROPOUT POSITVITE ADJUSTABLE REGULATOR |
| LP1083IZ | 制造商:FCI 制造商全稱:First Components International 功能描述:LOW DROPOUT POSITVITE ADJUSTABLE REGULATOR |
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