參數(shù)資料
型號： MA180023
廠商： Microchip Technology
文件頁數(shù)： 3/228頁
文件大?。?/td> 0K
描述： MODULE PLUG-IN PIC18F46J11 PIM
產(chǎn)品培訓(xùn)模塊： PIC18 J Series MCU Overview
標準包裝： 1
系列： PIC®
附件類型： 插拔式模塊（PIM）- PIC18F46J11
適用于相關(guān)產(chǎn)品： HPC Explorer 板（DM183022）或 PIC18 Explorer 板（DM183032）
產(chǎn)品目錄頁面： 658 (CN2011-ZH PDF)
配用： DM183032-ND - BOARD EXPLORER PICDEM PIC18
DM183022-ND - BOARD DEMO PIC18FXX22 64/80TQFP
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dsPIC30F3014/4013
DS70138G-page 100
2010 Microchip Technology Inc.
15.2
Framed SPI Support
The module supports a basic framed SPI protocol in
Master or Slave mode. The control bit, FRMEN,
enables framed SPI support and causes the SSx pin to
perform the Frame Synchronization pulse (FSYNC)
function. The control bit, SPIFSD, determines whether
the SSx pin is an input or an output (i.e., whether the
module receives or generates the Frame Synchroniza-
tion pulse). The frame pulse is an active-high pulse for
a single SPI clock cycle. When Frame Synchronization
is enabled, the data transmission starts only on the
subsequent transmit edge of the SPI clock.
FIGURE 15-1:
SPI BLOCK DIAGRAM
FIGURE 15-2:
SPI MASTER/SLAVE CONNECTION
Note: x = 1 or 2.
Read
Write
Internal
Data Bus
SDIx
SDOx
SSx
SCKx
SPIxSR
SPIxBUF
bit 0
Shift
Clock
Edge
Select
Enable Master Clock
SSx and
Control
Clock
Control
Transmit
SPIxBUF
Receive
FSYNC
FCY
Primary
1:1, 1:4,
Prescaler
Secondary
Prescaler
1:1-1:8
1:16, 1:64
Serial Input Buffer
(SPIxBUF)
Shift Register
(SPIxSR)
MSb
LSb
SDOx
SDIx
PROCESSOR 1
SCKx
SPI Master
Serial Input Buffer
(SPIyBUF)
Shift Register
(SPIySR)
LSb
MSb
SDIy
SDOy
PROCESSOR 2
SCKy
SPI Slave
Serial Clock
Note: x = 1 or 2, y = 1 or 2.
相關(guān)PDF資料
PDF描述
1-1589476-8 CONN RCPT 15POS 32AWG 24IN
0210490389 CABLE JUMPER 1.25MM .051M 32POS
0982660969 CBL 27POS 0.5MM JMPR TYPE A 3"
1-1589457-4 CONN RCPT 15POS 30AWG 24IN
0982660968 CBL 27POS 0.5MM JMPR TYPE D 3"
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參數(shù)描述
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