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參數(shù)資料
| 型號(hào)： | MB86290A |
| 廠商： | Fujitsu Limited |
| 英文描述： | Graphics Controller Hardware Specifications |
| 中文描述： | 圖形控制器硬件規(guī)格 |
| 文件頁數(shù)： | 101/184頁 |
| 文件大?。?/td> | 2659K |
| 代理商： | MB86290A |
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101
7.1.3 Display Control Register
DCM (Display Control Mode)
Register address
DisplayBaseAddress + 00h
Bit #
Bit field name
R/W
Default
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
CKS
Reserve
SC
Reserve
EO
Reserve
SOF
ESY
SYNC
RW
R0
RW
R0
RW
R0
RW
RW
RW
0
00
11110
00
0
0
0
0
00
This register controls the display mode. It is not initialized by a software
reset.
Bits 1-0
SYNC (Synchronize)
Set synchronization mode
X0
Non-interlace mode
11
Interlace video mode
Bit 2
ESY (External Synchronize)
Sets external synchronization mode
0
Disable
1
Enable
Bit 3
SF (Synchronize signal output format)
Sets active level of synchronization (VSYNC, HSYNC, CSYNC) signals
0
Low active
1
High active
Bit 5
EO (Even/Odd signal mode)
Defines EO signal output format
0
Low level output at even frame, High level output at odd frame
1
High level output at even frame, Low level output at odd frame
Bits 12-8
SC (Scaling)
Define pre-scaling ratio to generate dot clock
00000
No pre-scaling
00001
1/2
00010
1/3
:
:
11110
1/31 (default)
11111
1/32
Bit 15
CKS (Clock Source)
Selects source clock
0
Internal PLL output clock
1
DCLKI input
相關(guān)PDF資料 |
PDF描述 |
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