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參數(shù)資料
| 型號： | MB86290A |
| 廠商： | Fujitsu Limited |
| 英文描述： | Graphics Controller Hardware Specifications |
| 中文描述： | 圖形控制器硬件規(guī)格 |
| 文件頁數(shù)： | 113/184頁 |
| 文件大小： | 2659K |
| 代理商： | MB86290A |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁當前第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁
113
BLOA0 (BL-layer Origin Address 0)
Register address
DisplayBaseAddress + 74h
Bit #
Bit field name
R/W
Default
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10
9
8
7
6
5
4
3
2
1
0
Reserve
BLOA0
R0
RW
R0
0
Don
’
t care
0000
This register controls the base address of the logical frame (frame0) of the
Base Left (BL) layer. Since the lowest 4 bits are fixed to 0, this address is 16-
byte aligned.
BLDA0 (BL-layer Display Address 0)
Register address
DisplayBaseAddress + 78h
Bit #
Bit field name
R/W
Default
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10
9
8
7
6
5
4
3
2
1
0
Reserve
BLDA0
R0
RW
0
Don
’
t care
This register controls the base address of the Base Left (BL) layer display field
in frame0. When the direct color mode is used, the LSB is fixed to 0 and this
address is 2-byte aligned.
BLOA1 (BL-layer Origin Address 1)
Register address
DisplayBaseAddress + 7Ch
Bit #
Bit field name
R/W
Default
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10
9
8
7
6
5
4
3
2
1
0
Reserve
BLOA1
R0
RW
R0
0
Don
’
t care
0000
This register controls the base address of the logical frame (frame1) of the
Base Left (BL) layer. Since the lowest 4 bits are fixed to 0, this address is 16-
byte aligned.
BLDA1 (BL-layer Display Address 1)
Register address
DisplayBaseAddress + 80h
Bit #
Bit field name
R/W
Default
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10
9
8
7
6
5
4
3
2
1
0
Reserve
BLDA1
R0
RW
0
Don
’
t care
This register controls the base address of the Base Left (BL) layer display field
in frame1. When the direct color mode is used, the LSB is fixed to 0 and this
address is 2-byte aligned.
BLDX (BL-layer Display position X)
Register address
DisplayBaseAddress + 84h
Bit #
Bit field name
R/W
Default
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Reserved
BLDX
R0
RW
0
Don
’
t care
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PDF描述 |
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