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參數(shù)資料
| 型號： | MC68CK338 |
| 廠商： | Motorola, Inc. |
| 元件分類： | 32位微控制器 |
| 英文描述： | Highly Integrated, Low-Power, 32-Bit Microcontroller |
| 中文描述： | 高度集成，低功耗，32位微控制器 |
| 文件頁數(shù)： | 86/133頁 |
| 文件大?。?/td> | 798K |
| 代理商： | MC68CK338 |
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MOTOROLA
86
MC68CK338
MC68CK338TS/D
Figure 19 CPSM Block Diagram
6.5.1 CPSM Registers
The CPSM contains a control register and a test register. All unused bits and reserved address loca-
tions return zero when read by the software. Writing to unused bits and reserved address locations has
no effect.
PRUN — Prescaler Running
The PRUN bit is a read/write control bit that allows the software to switch the prescaler counter on and
off. This bit allows the counters in various CTM6 submodules to be synchronized. It is cleared by reset.
0 = Prescaler is held in reset and is not running
1 = Prescaler is running
DIV23 — Divide By 2/Divide By 3
The DIV23 bit is a read/write control bit that selects the division ratio of the first prescaler counter. It may
be changed by the software at any time and is cleared by reset.
0 = First prescaler stage divides by two
1 = First prescaler stage divides by three
PSEL[1:0] — Prescaler Division Ratio Select Field
This bit field selects the division ratio of the programmable prescaler output signal (PCLK6). Refer to
Table 49
.
CPCR —
CPSM Control Register
$YFF408
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
NOT USED
PRUN
DIV23
PSEL[1:0]
RESET:
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
CTM CPSM BLOCK
f
sys
8-BIT
PCLK2 =
PCLK3 =
PCLK4 =
PCLK5 =
PCLK6 =
FIRST CPSM
PRESCALER
SELECT
PCLK1 =
÷
2
÷
4
÷
8
÷
16
÷
32
÷
64
÷
128
÷
256
PRESCALER
PRUN
DIV23 PSEL1 PSEL0
CPCR
÷
2 or
÷
3
f
sys
÷
2
f
sys
÷
4
f
sys
÷
8
f
sys
÷
16
f
sys
÷
32
f
sys
÷
64
f
sys
÷
128
f
sys
÷
256
f
sys
÷
512
f
sys
÷
3
f
sys
÷
6
f
sys
÷
12
f
sys
÷
24
f
sys
÷
48
f
sys
÷
96
f
sys
÷
192
f
sys
÷
384
f
sys
÷
768
DIV23 =
÷
3
DIV23 =
÷
2
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PDF描述 |
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參數(shù)描述 |
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